參數(shù)資料
型號： SC9S12XF512J0CLH
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： MICROCONTROLLER, QFP64
封裝： LQFP-64
文件頁數(shù)： 1225/1306頁
文件大?。?/td> 8007K
代理商： SC9S12XF512J0CLH
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Chapter 20 Pulse Width Modulator with Fault Protection (PMF15B6C) Module
MC9S12XF - Family Reference Manual, Rev.1.19
Freescale Semiconductor
925
20.3.2.26 PMF Frequency Control B Register (PMFFQCB)
Read anytime and write only if MTG is set.
1
LDOKB
Load Okay B — If MTG is clear, this bit reads zero and cannot be written.
If MTG is set, this bit loads the PRSCB bits, the PMFMODB register and the PWMVAL2-3 registers into a set of
buffers. The buffered prescaler divisor B, PWM counter modulus B value, PWM2–3 pulse widths take effect at
the next PWM reload.
Set LDOKB by reading it when it is logic zero and then writing a logic one to it. LDOKB is automatically cleared
after the new values are loaded, or can be manually cleared before a reload by writing a logic zero to it. Reset
clears LDOKB.
0 Do not load new modulus B, prescaler B, and PWM2–3 values.
1 Load prescaler B, modulus B, and PWM2–3 values.
Note: Do not set PWMENB bit before setting the LDOKB bit and do not clear the LDOKB bit at the same time as
setting the PWMENB bit.
0
PWMRIEB
PWM Reload Interrupt Enable B — If MTG is clear, this bit reads zero and cannot be written.
If MTG is set, this bit enables the PWMRFB ag to generate CPU interrupt requests.
0 PWMRFB CPU interrupt requests disabled
1 PWMRFB CPU interrupt requests enabled
Address: $0029
76543210
R
LDFQB
HALFB
PRSCB
PWMRFB
W
Reset
0
00000
Figure 20-32. PMF Frequency Control B Register (PMFFQCB)
Table 20-29. PMFFQCB Field Descriptions
Field
Description
7–4
LDFQB
Load Frequency B — This eld selects the PWM load frequency according to Table 20-30. See
Note: The LDFQB eld takes effect when the current load cycle is complete, regardless of the state of the load
okay bit, LDOKB. Reading the LDFQB eld reads the buffered value and not necessarily the value
currently in effect.
3
HALFB
Half Cycle Reload B — This bit enables half-cycle reloads in center-aligned PWM mode. This bit has no effect
on edge-aligned PWMs.
0 Half-cycle reloads disabled
1 Half-cycle reloads enabled
2–1
PRSCB
Prescaler B — This buffered eld selects the PWM clock frequency illustrated in Table 20-31.
Note: Reading the PRSCB eld reads the buffered value and not necessarily the value currently in effect. The
PRSCB eld takes effect at the beginning of the next PWM cycle and only when the load okay bit, LDOKB,
is set.
Table 20-28. PMFENCB Field Descriptions (continued)
Field
Description
相關PDF資料
PDF描述
SC9S12XF512J0MLHR MICROCONTROLLER, QFP64
S3S12XF512J0VLH MICROCONTROLLER, QFP64
S9S12XF512J0CLMR MICROCONTROLLER, QFP112
SC9S12XF512J0VLMR MICROCONTROLLER, QFP112
MC9S12XHZ512CAL 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP112
相關代理商/技術參數(shù)
參數(shù)描述
SC9S12XF512J0CLHR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:S12X Microcontrollers
SC9S12XF512J0CLMR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:S12X Microcontrollers
SC9S12XF512J0MLHR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:S12X Microcontrollers
SC9S12XF512J0MLMR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:S12X Microcontrollers
SC9S12XF512J0VLHR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:S12X Microcontrollers
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