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參數(shù)資料
| 型號： | SC9S12XF512J0CLH |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MICROCONTROLLER, QFP64 |
| 封裝： | LQFP-64 |
| 文件頁數(shù)： | 1100/1306頁 |
| 文件大小： | 8007K |
| 代理商： | SC9S12XF512J0CLH |
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Chapter 17 Memory Protection Unit (S12XMPUV2)
MC9S12XF - Family Reference Manual, Rev.1.19
812
Freescale Semiconductor
The descriptors are banked in the MPU register map.
Each descriptor can be selected for modifying using the SEL bits in the MPU Descriptor Select (MPUSEL)
register.
Table 17-14 gives an overview of the types of accesses that can be congured using the protection
descriptors.
Table 17-14. Access Types
The minimum granularity of each descriptor is 8 bytes. This means the protection comparators in the MPU
module cover only address bits [22:3] of each access. The lower address bits (default [2:0], depending on
descriptor granularity) are ignored.
NOTE
A mis-aligned word access to the upper boundary address of a descriptor is
always agged as an access violation.
NOTE
Conguring the lower boundary address of a descriptor to be higher than the
upper boundary address of a descriptor causes this descriptor to be ignored
by the comparator block. This effectively disables the descriptor.
NOTE
Avoid changing descriptors while they are in active use to validate accesses
from bus-masters. This can be done by temporarily disabling the affected
master during the update (XGATE, Master 3, switch S12X CPU states).
Otherwise accesses from bus-masters affected by a descriptor which is
updated concurrently could yield undened results.
17.4.1.1
Overlapping Descriptors
If the memory ranges of two protection descriptors dened for the same bus-master overlap, the access
restrictions for the overlapped memory range are accumulated. For example:
a memory protection descriptor denes memory range 0x40_0000
0x41_FFFF as WP=1, NEX=0
(read and execute)
another descriptor denes memory range 0x41_0000
0x43_FFFF as WP=0, NEX=1 (read and
write)
the resulting access rights for the overlapping range 0x41_0000
0x41_FFFF are WP=1, NEX=1
(read only)
WP
NEX
Meaning
0
read, write and execute
0
1
read, write
1
0
read and execute
1
read only
相關PDF資料 |
PDF描述 |
|---|---|
| SC9S12XF512J0MLHR | MICROCONTROLLER, QFP64 |
| S3S12XF512J0VLH | MICROCONTROLLER, QFP64 |
| S9S12XF512J0CLMR | MICROCONTROLLER, QFP112 |
| SC9S12XF512J0VLMR | MICROCONTROLLER, QFP112 |
| MC9S12XHZ512CAL | 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP112 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| SC9S12XF512J0CLHR | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:S12X Microcontrollers |
| SC9S12XF512J0CLMR | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:S12X Microcontrollers |
| SC9S12XF512J0MLHR | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:S12X Microcontrollers |
| SC9S12XF512J0MLMR | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:S12X Microcontrollers |
| SC9S12XF512J0VLHR | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:S12X Microcontrollers |
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