參數(shù)資料
型號(hào)： SATMEGA32A-ANR
廠商： ATMEL CORP
元件分類(lèi)： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 16 MHz, RISC MICROCONTROLLER, PQFP44
封裝： 10 X 10 MM, 1 MM HEIGHT, 0.80 MM PITCH, GREEN, PLASTIC, MS-026ACB, TQFP-44
文件頁(yè)數(shù)： 28/353頁(yè)
文件大?。?/td> 5149K
代理商： SATMEGA32A-ANR
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8155C–AVR–02/11
ATmega32A
The setup of the OC2 should be performed before setting the Data Direction Register for the port
pin to output. The easiest way of setting the OC2 value is to use the Force Output Compare
(FOC2) strobe bit in Normal mode. The OC2 Register keeps its value even when changing
between Waveform Generation modes.
Be aware that the COM2[1:0] bits are not double buffered together with the compare value.
Changing the COM2[1:0] bits will take effect immediately.
17.6
Compare Match Output Unit
The Compare Output mode (COM21:0) bits have two functions. The Waveform Generator uses
the COM2[1:0] bits for defining the Output Compare (OC2) state at the next compare match.
Also, the COM2[1:0] bits control the OC2 pin output source. Figure 17-4 shows a simplified
schematic of the logic affected by the COM2[1:0] bit setting. The I/O Registers, I/O bits, and I/O
pins in the figure are shown in bold. Only the parts of the general I/O Port Control Registers
(DDR and PORT) that are affected by the COM2[1:0] bits are shown. When referring to the OC2
state, the reference is for the internal OC2 Register, not the OC2 pin.
Figure 17-4. Compare Match Output Unit, Schematic
The general I/O port function is overridden by the Output Compare (OC2) from the waveform
generator if either of the COM2[1:0] bits are set. However, the OC2 pin direction (input or output)
is still controlled by the Data Direction Register (DDR) for the port pin. The Data Direction Regis-
ter bit for the OC2 pin (DDR_OC2) must be set as output before the OC2 value is visible on the
pin. The port override function is independent of the Waveform Generation mode.
The design of the output compare pin logic allows initialization of the OC2 state before the out-
put is enabled. Note that some COM2[1:0] bit settings are reserved for certain modes of
operation. “Register Description” on page 132
17.6.1
Compare Output Mode and Waveform Generation
The waveform generator uses the COM2[1:0] bits differently in Normal, CTC, and PWM modes.
For all modes, setting the COM2[1:0] = 0 tells the Waveform Generator that no action on the
OC2 Register is to be performed on the next compare match. For compare output actions in the
non-PWM modes refer to Table 17-3 on page 133. For fast PWM mode, refer to Table 17-4 on
page 134, and for phase correct PWM refer to Table 17-5 on page 134.
PORT
DDR
DQ
OCn
Pin
OCn
DQ
Waveform
Generator
COMn1
COMn0
0
1
D
ATA
B
U
S
FOCn
clk
I/O
相關(guān)PDF資料
PDF描述
SAW04A0A SINGLE COLOR LED, COOL WHITE
SAX-XC878-13FFI3V3 8-BIT, FLASH, 24 MHz, RISC MICROCONTROLLER, PQFP64
SAX-XC878-13FFI5V 8-BIT, FLASH, 24 MHz, RISC MICROCONTROLLER, PQFP64
SAX-XC878CM-13FFI5V 8-BIT, FLASH, 24 MHz, RISC MICROCONTROLLER, PQFP64
SAX-XC878M-16FFI3V3 8-BIT, FLASH, 24 MHz, RISC MICROCONTROLLER, PQFP64
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
SAT-MX-10-R 制造商:3M Electronic Products Division 功能描述:SAT-MX-10-R SLIC STUBBED AERIA 80611319551 制造商:3M Electronic Products Division 功能描述:SLIC STUBBED AERIAL TERMINAL 10 PR UNPROT MX2000 RIGHT ENTRY
SAT-MXP-10-L 制造商:3M Electronic Products Division 功能描述:SLIC STUBBED AERIAL TERMINAL 10 PR MX2000 PROT LEFT ENTRY
SATP4032G-CMM 制造商:PRETEC 功能描述:DRIVESSD 32GB 2.5" SATA IIP4000 MLC
SATP4128G-CMM 制造商:PRETEC 功能描述:DRIVESSD 128GB 2.5" SATA IIP4000 MLC
SATP4256G-CMM 制造商:PRETEC 功能描述:DRIVESSD 256GB 2.5" SATA IIP4000 MLC
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