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參數(shù)資料
| 型號： | SATMEGA32A-ANR |
| 廠商： | ATMEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 16 MHz, RISC MICROCONTROLLER, PQFP44 |
| 封裝： | 10 X 10 MM, 1 MM HEIGHT, 0.80 MM PITCH, GREEN, PLASTIC, MS-026ACB, TQFP-44 |
| 文件頁數(shù)： | 154/353頁 |
| 文件大?。?/td> | 5149K |
| 代理商： | SATMEGA32A-ANR |
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237
8155C–AVR–02/11
ATmega32A
The active states are:
Capture-DR: Data in the IDCODE-register is sampled into the Boundary-scan Chain.
Shift-DR: The IDCODE scan chain is shifted by the TCK input.
24.4.3
SAMPLE_PRELOAD; $2
Mandatory JTAG instruction for pre-loading the output latches and talking a snap-shot of the
input/output pins without affecting the system operation. However, the output latches are not
connected to the pins. The Boundary-scan Chain is selected as Data Register.
The active states are:
Capture-DR: Data on the external pins are sampled into the Boundary-scan Chain.
Shift-DR: The Boundary-scan Chain is shifted by the TCK input.
Update-DR: Data from the Boundary-scan Chain is applied to the output latches. However,
the output latches are not connected to the pins.
24.4.4
AVR_RESET; $C
The AVR specific public JTAG instruction for forcing the AVR device into the Reset mode or
releasing the JTAG Reset source. The TAP controller is not reset by this instruction. The one bit
Reset Register is selected as Data Register. Note that the reset will be active as long as there is
a logic 'one' in the Reset Chain. The output from this chain is not latched.
The active states are:
Shift-DR: The Reset Register is shifted by the TCK input.
24.4.5
BYPASS; $F
Mandatory JTAG instruction selecting the Bypass Register for Data Register.
The active states are:
Capture-DR: Loads a logic “0” into the Bypass Register.
Shift-DR: The Bypass Register cell between TDI and TDO is shifted.
24.5
Boundary-scan Chain
The Boundary-scan chain has the capability of driving and observing the logic levels on the digi-
tal I/O pins, as well as the boundary between digital and analog logic for analog circuitry having
Off-chip connection.
24.5.1
Scanning the Digital Port Pins
Figure 24-3 shows the Boundary-scan Cell for a bi-directional port pin with pull-up function. The
cell consists of a standard Boundary-scan cell for the Pull-up Enable – PUExn – function, and a
bi-directional pin cell that combines the three signals Output Control – OCxn, Output Data –
ODxn, and Input Data – IDxn, into only a two-stage Shift Register. The port and pin indexes are
not used in the following description.
The Boundary-scan logic is not included in the figures in the datasheet. Figure 24-4 shows a
simple digital Port Pin as described in the section “I/O Ports” on page 50. The Boundary-scan
details from Figure 24-3 replaces the dashed box in Figure 24-4.
When no alternate port function is present, the Input Data – ID – corresponds to the PINxn Reg-
ister value (but ID has no synchronizer), Output Data corresponds to the PORT Register, Output
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| SAT-MXP-10-L | 制造商:3M Electronic Products Division 功能描述:SLIC STUBBED AERIAL TERMINAL 10 PR MX2000 PROT LEFT ENTRY |
| SATP4032G-CMM | 制造商:PRETEC 功能描述:DRIVESSD 32GB 2.5" SATA IIP4000 MLC |
| SATP4128G-CMM | 制造商:PRETEC 功能描述:DRIVESSD 128GB 2.5" SATA IIP4000 MLC |
| SATP4256G-CMM | 制造商:PRETEC 功能描述:DRIVESSD 256GB 2.5" SATA IIP4000 MLC |
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