參數(shù)資料
型號： SATMEGA32A-ANR
廠商： ATMEL CORP
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 16 MHz, RISC MICROCONTROLLER, PQFP44
封裝： 10 X 10 MM, 1 MM HEIGHT, 0.80 MM PITCH, GREEN, PLASTIC, MS-026ACB, TQFP-44
文件頁數(shù)： 113/353頁
文件大小： 5149K
代理商： SATMEGA32A-ANR
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20
8155C–AVR–02/11
ATmega32A
EEPROM data corruption can easily be avoided by following this design recommendation:
Keep the AVR RESET active (low) during periods of insufficient power supply voltage. This
can be done by enabling the internal Brown-out Detector (BOD). If the detection level of the
internal BOD does not match the needed detection level, an external low V
CC Reset Protec-
tion circuit can be used. If a reset occurs while a write operation is in progress, the write
operation will be completed provided that the power supply voltage is sufficient.
7.5
I/O Memory
The I/O space definition of the Atmel
AVR ATmega32A is shown in “Register Summary” on
All ATmega32A I/Os and peripherals are placed in the I/O space. The I/O locations are
accessed by the IN and OUT instructions, transferring data between the 32 general purpose
working registers and the I/O space. I/O Registers within the address range $00 - $1F are
directly bit-accessible using the SBI and CBI instructions. In these registers, the value of single
bits can be checked by using the SBIS and SBIC instructions. Refer to the Instruction Set sec-
tion for more details. When using the I/O specific commands IN and OUT, the I/O addresses $00
- $3F must be used. When addressing I/O Registers as data space using LD and ST instruc-
tions, $20 must be added to these addresses.
For compatibility with future devices, reserved bits should be written to zero if accessed.
Reserved I/O memory addresses should never be written.
Some of the Status Flags are cleared by writing a logical one to them. Note that the CBI and SBI
instructions will operate on all bits in the I/O Register, writing a one back into any flag read as
set, thus clearing the flag. The CBI and SBI instructions work with registers $00 to $1F only.
The I/O and Peripherals Control Registers are explained in later sections.
7.6
Register Description
7.6.1
EEARH and EEARL – EEPROM Address Register
Bits [15:10] – Reserved Bits
These bits are reserved bits in the ATmega32A and will always read as zero.
Bits [9:0] – EEAR9:0: EEPROM Address
The EEPROM Address Registers – EEARH and EEARL – specify the EEPROM address in the
1024bytes EEPROM space. The EEPROM data bytes are addressed linearly between 0 and
1023. The initial value of EEAR is undefined. A proper value must be written before the
EEPROM may be accessed.
Bit
151413
121110
9
8
–––
EEAR9
EEAR8
EEARH
EEAR7
EEAR6
EEAR5
EEAR4
EEAR3
EEAR2
EEAR1
EEAR0
EEARL
765
432
10
Read/Write
RR
RRR
R
R/W
Initial Value
0
X
XXXX
XXX
相關(guān)PDF資料
PDF描述
SAW04A0A SINGLE COLOR LED, COOL WHITE
SAX-XC878-13FFI3V3 8-BIT, FLASH, 24 MHz, RISC MICROCONTROLLER, PQFP64
SAX-XC878-13FFI5V 8-BIT, FLASH, 24 MHz, RISC MICROCONTROLLER, PQFP64
SAX-XC878CM-13FFI5V 8-BIT, FLASH, 24 MHz, RISC MICROCONTROLLER, PQFP64
SAX-XC878M-16FFI3V3 8-BIT, FLASH, 24 MHz, RISC MICROCONTROLLER, PQFP64
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
SAT-MX-10-R 制造商:3M Electronic Products Division 功能描述:SAT-MX-10-R SLIC STUBBED AERIA 80611319551 制造商:3M Electronic Products Division 功能描述:SLIC STUBBED AERIAL TERMINAL 10 PR UNPROT MX2000 RIGHT ENTRY
SAT-MXP-10-L 制造商:3M Electronic Products Division 功能描述:SLIC STUBBED AERIAL TERMINAL 10 PR MX2000 PROT LEFT ENTRY
SATP4032G-CMM 制造商:PRETEC 功能描述:DRIVESSD 32GB 2.5" SATA IIP4000 MLC
SATP4128G-CMM 制造商:PRETEC 功能描述:DRIVESSD 128GB 2.5" SATA IIP4000 MLC
SATP4256G-CMM 制造商:PRETEC 功能描述:DRIVESSD 256GB 2.5" SATA IIP4000 MLC
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