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參數(shù)資料
| 型號(hào)： | MT8LLN22NCNE |
| 元件分類(lèi)： | 總線控制器 |
| 英文描述： | PCI BUS CONTROLLER, PBGA316 |
| 封裝： | 27 X 27 MM, PLASTIC, BGA-316 |
| 文件頁(yè)數(shù)： | 33/145頁(yè) |
| 文件大小： | 2285K |
| 代理商： | MT8LLN22NCNE |
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Coppertail Product Specification
MT8LLN22NCNE.fm – Rev. 1, Pub. 2/02
128
2002, Micron Technology Inc.
PRELIMINARY
MT8LLN22NCNE
COPPERTAIL
G0/S0/C1
G0/S0/C0
Enabled break event.
G0/S0/C1
G0/S0/C2
H_STPCLK# asserted.
G0/S0/C1
G2/S5
Power Button Override.
G0/S0/C1
G3
Power failure.
G0/S0/C2
G0/S0/C0
Enabled break event.
G0/S0/C2
G0/S0/C1
H_STPCLK# goes inactive and previously in C1.
G0/S0/C2
G2/S5
Power button override.
G0/S0/C2
G3
Power failure.
G1/S1, G1/S3, G1/S4
G0/S0/C0
Enabled wake event.
G1/S1, G1/S3, G1/S4
G2/S5
Power button override.
G1/S1, G1/S3, G1/S4
G3
Power failure.
G2/S5
G0/S0/C0
Enabled wake event.
G2/S5
G3
Power failure.
G3
G0/S0/C0
Power returns. Optional reboot.
G3
G2/S5
Power returns. Optional stay off until wake event.
G0/S0/C0
G0/S0/C1
Processor HALT instruction.
G0/S0/C0
G0/S0/C2
Level 2 Read.
G0/S0/C0
G0/S0/C3
Level 3 Read.
Table 27
Power State Transition Rules (continued)
CURRENT STATE
NEXT STATE
TRANSITION EVENT
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MTB10N40ET4 | 10 A, 400 V, 0.55 ohm, N-CHANNEL, Si, POWER, MOSFET |
| MTB15N06V | 15 A, 60 V, 0.12 ohm, N-CHANNEL, Si, POWER, MOSFET |
| MTB15N06VT4 | 15 A, 60 V, 0.12 ohm, N-CHANNEL, Si, POWER, MOSFET |
| MTB16N25E | 16 A, 250 V, 0.25 ohm, N-CHANNEL, Si, POWER, MOSFET |
| MTB16N25ET4 | 16 A, 250 V, 0.25 ohm, N-CHANNEL, Si, POWER, MOSFET |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| MT8LLN22NCNE-A2 | 制造商:Micron Technology Inc 功能描述:COPPERTAIL CHIPSET AND MOTHERBOARD - Trays |
| MT8LSDF3264WG-133D1 | 制造商:Micron Technology Inc 功能描述:256MB 32MX64 SYNCH DRAM MODULE MICRO DIMM 3.3V - Trays |
| MT8LSDT1664 | 制造商:Micron Technology Inc 功能描述:128MB 16MX64 SDRAM MODULE PBF DIMM 3.3V - Trays |
| MT8LSDT1664AG-10EB1 | 制造商:Micron Technology Inc 功能描述:DRAM MOD SDRAM 1GBIT 168UDIMM - Trays |
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