參數(shù)資料
型號： MPC9774
廠商： Motorola, Inc.
英文描述： 3.3V / 2,5V 1:14 LVCMOS PLL CLOCK GENERATOR
中文描述： 3.3 / 2,5 V 13:14:00的LVCMOS PLL時鐘發(fā)生器
文件頁數(shù)： 12/16頁
文件大?。?/td> 217K
代理商： MPC9774
MPC9774
MOTOROLA
TIMING SOLUTIONS
12
Figure 12. Output–to–output Skew tSK(O)
Figure 13. Propagation delay (t(
)
, static phase
offset) test reference
Figure 14. Output Duty Cycle (DC)
The pin–to–pin skew is defined as the worst case difference in
propagation delay between any simlar delay path within a
single device
The time fromthe PLL controlled edge to the non controlled
edge, divided by the time between PLL controlled edges,
expressed as a percentage
VCC
VCC
GND
2
VCC
VCC
2
GND
tSK(O)
VCC
VCC
GND
2
tP
T0
DC = tP/T0
x
100%
VCC
VCC
GND
2
VCC
VCC
2
GND
t(
)
CCLKx
FB_IN
TJIT(
) =
|
T0–T1mean
|
CCLKx
FB_IN
The deviation in t0 for a controlled edge with respect to a t0 mean in a
randomsample of cycles
Figure 15. I/O Jitter
Figure 16. Cycle–to–cycle Jitter
Figure 17. Period Jitter
The variation in cycle time of a signal between adjacent cycles, over a
randomsample of adjacent cycle pairs
The deviation in cycle time of a signal with respect to the ideal period over
a randomsample of cycles
TN
tIT(CC) =
|
TN – TN + 1
|
TN+1
tIT(PER) =
|
TN – (1
÷
f0
)|
T0
tF
tR
VCC = 3.3V
2.4
VCC = 2.5V
1.8V
0.55
0.6V
Figure 18. Output Transition Time Test Reference
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PDF描述
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參數(shù)描述
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