參數(shù)資料
型號(hào)： MPC973
廠商： Motorola, Inc.
英文描述： LOW VOLTAGE PLL CLOCK DRIVER
中文描述： 低壓PLL時(shí)鐘驅(qū)動(dòng)器
文件頁(yè)數(shù)： 2/14頁(yè)
文件大?。?/td> 182K
代理商： MPC973
MPC972 MPC973
MOTOROLA
TIMING SOLUTIONS
BR1333 — Rev 6
2
fselb1
fselb0
fsela1
fsela0
Qa3
VCCO
Qa2
GNDO
Qa1
VCCO
Qa0
GNDO
VCO_Sel
fselFB1
QSync
GNDO
Qc0
VCCO
Qc1
fselc0
fselc1
Qc2
VCCO
Qc3
GNDO
Inv_Clk
G
Q
V
Q
G
Q
V
Q
E
G
Q
V
f
G
M
F
F
f
P
R
T
T
T
x
x
V
40
41
42
43
44
45
46
47
48
49
50
51
52
25
24
23
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21
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18
17
16
15
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1
2
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4
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6
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11
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13
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38
37
36
35
34
33
32
31
30
29
28
27
26
MPC972/
MPC973
P
P
Figure 1. 52–Lead Pinout
(Top View)
FUNCTION TABLE 1
fsela1
fsela0
Qa
fselb1
fselb0
Qb
fselc1
fselc0
Qc
0
0
1
1
0
1
0
1
÷
4
÷
6
÷
8
÷
12
0
0
1
1
0
1
0
1
÷
4
÷
6
÷
8
÷
10
0
0
1
1
0
1
0
1
÷
2
÷
4
÷
6
÷
8
FUNCTION TABLE 2
fselFB2
fselFB1
fselFB0
QFB
0
0
0
0
0
0
1
1
0
1
0
1
÷
4
÷
6
÷
8
÷
10
1
1
1
1
0
0
1
1
0
1
0
1
÷
8
÷
12
÷
16
÷
20
FUNCTION TABLE 3
Control Pin
Logic ‘0’
Logic ‘1’
VCO_Sel
Ref_Sel
TCLK_Sel
PLL_En
MR/OE
Inv_Clk
VCO/2
TCLK
TCLK0
Bypass PLL
VCO
Xtal (PECL)
TCLK1
Enable PLL
Enable Outputs
Inverted Qc2, Qc3
Master Reset/Output Hi–Z
Non–Inverted Qc2, Qc3
相關(guān)PDF資料
PDF描述
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