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參數(shù)資料
| 型號： | MCF5232 |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | Integrated Microprocessor Hardware Specification |
| 中文描述： | 集成的微處理器，硬件規(guī)格 |
| 文件頁數(shù)： | 49/60頁 |
| 文件大?。?/td> | 1462K |
| 代理商： | MCF5232 |
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Preliminary Electrical Characteristics
MCF523x Integrated Microprocessor Hardware Specification, Rev. 1.3
Preliminary
Freescale Semiconductor
49
Figure 17. RESET and Configuration Override Timing
* Refer to the Coldfire Integration Module (CIM) section for more information.
6.9
Table 35
lists specifications for the I
2
C input timing parameters shown in
Figure 18
.
Table 35. I
2
C Input Timing Specifications between I2C_SCL and I2C_SDA
I
2
C Input/Output Timing Specifications
Table 36
lists specifications for the I
2
C output timing parameters shown in
Figure 18
.
Table 36. I
2
C Output Timing Specifications between I2C_SCL and I2C_SDA
Num
Characteristic
Min
Max
Units
I1
Start condition hold time
2
—
t
cyc
I2
Clock low period
8
—
t
cyc
I3
I2C_SCL/I2C_SDA rise time (V
IL
= 0.5 V to V
IH
= 2.4 V)
—
1
ms
I4
Data hold time
0
—
ns
I5
I2C_SCL/I2C_SDA fall time (V
IH
= 2.4 V to V
IL
= 0.5 V)
—
1
ms
I6
Clock high time
4
—
t
cyc
I7
Data setup time
0
—
ns
I8
Start condition setup time (for repeated start condition only)
2
—
t
cyc
I9
Stop condition setup time
2
—
t
cyc
Num
Characteristic
Min
Max
Units
I1
1
Start condition hold time
6
—
t
cyc
I2
1
Clock low period
10
—
t
cyc
I3
2
I2C_SCL/I2C_SDA rise time (V
IL
= 0.5 V to
V
IH
= 2.4 V)
—
—
μs
I4
1
Data hold time
7
—
t
cyc
I5
3
I2C_SCL/I2C_SDA fall time (V
IH
= 2.4 V to
V
IL
= 0.5 V)
—
3
ns
I6
1
Clock high time
10
—
t
cyc
R1
R2
CLKOUT
RESET
RSTOUT
R3
R4
R8
R7
R6
R5
Configuration Overrides*:
(RCON, Override pins])
R4
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