參數(shù)資料
型號： MC56F8123
廠商： Motorola, Inc.
英文描述： 16-bit Hybrid Controllers
中文描述： 16位混合控制器
文件頁數(shù)： 79/140頁
文件大?。?/td> 1981K
代理商： MC56F8123
Peripheral Memory Mapped Registers
56F8323 Technical Data, Rev. 11.0
Freescale Semiconductor
43
Preliminary
DEC0_UPOSH
$9
Upper Position Hold Register
DEC0_LPOSH
$A
Lower Position Hold Register
DEC0_UIR
$B
Upper Initialization Register
DEC0_LIR
$C
Lower Initialization Register
DEC0_IMR
$D
Input Monitor Register
Table 4-12 Interrupt Control Registers Address Map
(ITCN_BASE = $00 F1A0)
Register Acronym
Address Offset
Register Description
IPR0
$0
Interrupt Priority Register 0
IPR1
$1
Interrupt Priority Register 1
IPR2
$2
Interrupt Priority Register 2
IPR3
$3
Interrupt Priority Register 3
IPR4
$4
Interrupt Priority Register 4
IPR5
$5
Interrupt Priority Register 5
IPR6
$6
Interrupt Priority Register 6
IPR7
$7
Interrupt Priority Register 7
IPR8
$8
Interrupt Priority Register 8
IPR9
$9
Interrupt Priority Register 9
VBA
$A
Vector Base Address Register
FIM0
$B
Fast Interrupt Match Register 0
FIVAL0
$C
Fast Interrupt Vector Address Low 0 Register
FIVAH0
$D
Fast Interrupt Vector Address High 0 Register
FIM1
$E
Fast Interrupt Match Register 1
FIVAL1
$F
Fast Interrupt Vector Address Low 1 Register
FIVAH1
$10
Fast Interrupt Vector Address High 1 Register
IRQP0
$11
IRQ Pending Register 0
IRQP1
$12
IRQ Pending Register 1
IRQP2
$13
IRQ Pending Register 2
IRQP3
$14
IRQ Pending Register 3
IRQP4
$15
IRQ Pending Register 4
IRQP5
$16
IRQ Pending Register 5
Reserved
ICTL
$1D
Interrupt Control Register
Table 4-11 Quadrature Decoder 0 Registers Address Map (Continued)
(DEC0_BASE = $00 F180)
Quadrature Decoder is NOT available in the 56F8123 device
Register Acronym
Address Offset
Register Description
相關PDF資料
PDF描述
MC56F8323 16-bit Hybrid Controllers
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MC56MS-5 3500 MHz - 12000 MHz RF/MICROWAVE DOUBLE BALANCED MIXER, 9.5 dB CONVERSION LOSS-MAX
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相關代理商/技術參數(shù)
參數(shù)描述
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