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參數(shù)資料
| 型號(hào)： | MC33989DWR2 |
| 廠商： | Freescale Semiconductor |
| 文件頁(yè)數(shù)： | 32/72頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC SYSTEM BASE W/CAN 28-SOIC |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 控制器類型： | 系統(tǒng)基礎(chǔ)芯片 |
| 接口： | CAN |
| 電源電壓： | 5.5 V ~ 18 V |
| 電流 - 電源： | 45mA |
| 工作溫度： | -40°C ~ 125°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 28-SOIC（0.295"，7.50mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 28-SOIC W |
| 包裝： | 剪切帶 (CT) |
| 配用： | KIT33989DWEVB-ND - KIT EVAL 33989DW HS SBC |
| 其它名稱： | MC33989DWR2CT |
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Analog Integrated Circuit Device Data
38
Freescale Semiconductor
33989
FUNCTIONAL DEVICE OPERATION
LOGIC COMMANDS AND REGISTERS
Figure 19. HS1 Operation when Cyclic Sense is Selected
Low Power Mode Control Register (LPC)
This register controls:
The state of HS1 in Stop and Sleep mode (HS1 permanently off or HS1 cyclic)
Enable or disable the forced wake-up function (SBC automatic wake-up after time spend in Sleep or Stop modes, time is
defined by the TIM2 register)
Enable or disable the sense of the wake-up inputs (Lx) at sampling point of the Cyclic Sense period (LX2HS1 bit).
Refer to the Cyclic Sense Wake-up discussion for details of the LPC register setup required for proper Cyclic Sense or direct
wake-up operation.
Table 28. TIM1 Control Bits
CSP2
CSP1
CSP0
Cyclic Sense Timing (ms)
Parameter
0
5
Cyclic Sense/FWU Timing 1
0
1
10
Cyclic Sense/FWU Timing 2
0
1
0
20
Cyclic Sense/FWU Timing 3
0
1
40
Cyclic Sense/FWU Timing 4
1
0
75
Cyclic Sense/FWU Timing 5
1
0
1
100
Cyclic Sense/FWU Timing 6
1
0
200
Cyclic Sense/FWU Timing 7
1
400
Cyclic Sense/FWU Timing 8
Table 29. LPC Register
LPC
D3
D2
D1
D0
$110B
W
LX2HS1
FWU
—
HS1AUTO
R
—
Reset Value
0
—
0
Reset Condition
POR, NR2R
N2R,STB2RSTO2R
POR, NR2R
N2R,STB2RSTO2R
—
POR, NR2R
N2R,STB2RSTO2R
Table 30. LX2HS1 Control Bits
LX2HS1
Wake-up Inputs Supplied by HS1
Cyclic Sense Timing, Off Time
Cyclic Sense on Time
t
HS1
Sample
10 s
HS1 OFF
HS1 ON
Lx Sampling Point
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