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參數(shù)資料
| 型號： | MB95F564KPF-G-JNE2 |
| 廠商： | Fujitsu Semiconductor America Inc |
| 文件頁數(shù)： | 48/84頁 |
| 文件大小： | 0K |
| 描述： | IC MCU 8BIT 20KB FLASH 20TSSOP |
| 標準包裝： | 1,225 |
| 系列： | 8FX MB95560H |
| 核心處理器： | F²MC-8FX |
| 芯體尺寸： | 8-位 |
| 速度： | 16MHz |
| 連通性： | LIN，UART/USART |
| 外圍設(shè)備： | LVD. POR，PWM，WDT |
| 輸入/輸出數(shù)： | 17 |
| 程序存儲器容量： | 20KB（20K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 496 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.4 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 6x8/10b |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 20-SOIC（0.295"，7.50mm 寬） |
| 包裝： | 托盤 |
| 其它名稱： | 865-1239 |
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MB95560H/570H/580H Series
52
DS702-00010-2v0-E
FCH
(Main oscillation clock)
Divided by 2
FMPLL
(Main CR PLL)
FCRH
(Main CR clock)
FCL
(Sub-oscillation clock)
FCRL
(Sub-CR clock)
SCLK
(Source clock)
MCLK
(Machine clock)
Machine clock divide ratio select bits
(SYCC:DIV1, DIV0)
Clock mode select bits
(SYCC2: RCS1, RCS0)
Division circuit
×
1
1/4
1/8
1/16
Schematic diagram of the clock generation block
Oper
a
ting
volt
a
ge
(V)
A/D converter operation range
5.5
5.0
4.0
3.5
3.0
2.7
2.4
16 kHz
3 MHz
10 MHz
16.25 MHz
Source clock frequency (FSP/FSPL)
Oper
a
ting
volt
a
ge
(V)
A/D converter operation range
5.5
5.0
4.0
3.5
3.0
2.9
16 kHz
3 MHz
12.5 MHz
16.25 MHz
Source clock frequency (FSP)
Operating voltage - Operating frequency (When TA =
40°C to + 85°C)
MB95560H/570H/580H (without the on-chip debug function)
Operating voltage - Operating frequency (When TA =
40°C to + 85°C)
MB95560H/570H/580H (with the on-chip debug function)
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PDF描述 |
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