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參數(shù)資料
| 型號： | MB86277PMC-G-BNDE1 |
| 廠商： | Fujitsu Semiconductor America Inc |
| 文件頁數(shù)： | 248/277頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC GRAPHIC CTRLR 2D 256LQFP |
| 特色產(chǎn)品： | Graphics Display Controllers (GDC) |
| 標(biāo)準(zhǔn)包裝： | 100 |
| 類型： | 視頻、圖形控制器 |
| 應(yīng)用： | TV |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 256-LQFP |
| 供應(yīng)商設(shè)備封裝： | 256-LQFP（28x28） |
| 包裝： | 托盤 |
| 其它名稱： | 865-1180 |
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FUJITSU LIMITED
PRELIMINARY and CONFIDENTIAL
MB86277 MINT
Graphics Controller
72
Specifications Rev. 1.0
7
7....3
3
Scaling
7.3.1 Video Reduction Function
When the CM bits of the video capture mode register (VCM) are 11, MINT reduces the video screen size.
The reduction can be set independently in the vertical and horizontal scales.
The reduction is set per line
in the vertical direction and in 2-pixel units in the horizontal direction.
The scale setting value is defined
by an input/output value.
It is a 16-bit fixed fraction where the integer is represented by 5 bits and the
fraction is represented by 11 bits.
Valid setting values are from 0800H to FFFFH.
Set the vertical
direction at bit 31 to bit 16 of the capture scale register (CSC) and the horizontal direction at bits 15 to bit
00.
The initial value for this register is 08000800H (once).
An example of the expressions for setting a
reduction in the vertical and horizontal directions is shown below.
Reduction in vertical direction
576
→ 490 lines
576/490 = 1.176
1.176
×2048=2408
→ 0968H
Reduction in horizontal direction
720
→ 648 pixels
720/648 = 1.111
1.111
×2048=2275
→ 08E3H
Therefore, 096808E3H is set in CSC.
The capture horizontal pixel register (CHP) and capture vertical pixel register (CVP) are used to limit the
number of pixels processed during scaling.
They are not used to set scaling values.
Clamp processing
is performed on the video streaming data outside the values set in CHP and CVP.
Usually, the defaults
for these registers are used.
7.3.2 Vertical Interpolation
When the VI bit of the video capture mode register (VCM) is “0”, data in the same field is used to
interpolate the interlace screen vertically.
The interlace screen is doubled in the vertical direction.
When the VI bit is “1”, the interlace screen is not interpolated vertically.
7
7....4
4
Error Handling
7.4.1 Error Detection Function
If an expected control code is not detected in the input video stream, an error occurs.
If an error occurs,
the status is returned to the register.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MB86297APBH-GSE1 | IC GRAPHIC CTRLR 2/3D 543BGA |
| MB88F332ABPMC-GSE1 | IC GRAPHIC DISPLAY CTRLR 208LQFP |
| MC100E111FNR2 | IC CLK BUFFER 1:9 800MHZ 28-PLCC |
| MC100E210FNR2 | IC CLOCK BUFFER 1:4/1:5 28-PLCC |
| MC100E310FNR2 | IC CLOCK BUFFER MUX 2:8 28-PLCC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MB86277PMC-GS-BNDE1 | 制造商:FUJITSU 功能描述:CONTROLLER GRAPHIC MINT 256LQFP |
| MB86277PMCR-GS-BNDE1 | 制造商:FUJITSU 功能描述: |
| MB86290A | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:Graphics Controller Hardware Specifications |
| MB86290APVSR-G-BNDE1 | 制造商:FUJITSU 功能描述: |
| MB86291A | 制造商:Fujitsu 功能描述: |
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