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參數(shù)資料
| 型號(hào)： | MB86277PMC-G-BNDE1 |
| 廠商： | Fujitsu Semiconductor America Inc |
| 文件頁數(shù)： | 169/277頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC GRAPHIC CTRLR 2D 256LQFP |
| 特色產(chǎn)品： | Graphics Display Controllers (GDC) |
| 標(biāo)準(zhǔn)包裝： | 100 |
| 類型： | 視頻、圖形控制器 |
| 應(yīng)用： | TV |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 256-LQFP |
| 供應(yīng)商設(shè)備封裝： | 256-LQFP（28x28） |
| 包裝： | 托盤 |
| 其它名稱： | 865-1180 |
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FUJITSU LIMITED
PRELIMINARY and CONFIDENTIAL
MB86277 MINT
Graphics Controller
250
Specifications Rev. 1.0
1) Enable the hardware wait for the areas to which MINT is connected.
When the normally not ready
mode (RDY_MODE = 0) is used, set the software wait count to “1”.
When the normally ready mode
(RDY_MODE = 1) is used, set the count to “2”.
When the normally ready mode is used
(RDY_MODE = 1) and BS_MODE = L, set the software wait to 2.
When the normally ready mode is
enabled and
BS_MODE = H, set the software wait to “3”.
2) When starting DMA by issuing an external request, do so after setting the transfer count register
(DTCR) and mode setting register (DSUR) of MINT to the same value as the CPU setting.
In the
dual DMA without ACK mode or V832 mode, there is no need to set DTCR.
3) When MINT is read-/write-accessed from the CPU during DMA transfer, do not access the registers
and memories related to DMA transfer.
If these registers and memories are accessed, reading and
writing of the correct value is not assured.
4) Set DREQ (DMARQ) to “Low” level detection.
5) Set the DACK/DRACK of SH to high active output, DMAAK of V832 to high active, and XTC of V832
to low active.
12
12....5
5
5 SH3 Mode
SH3 Mode
1) When the XRDY pin is low, it is in the wait state.
2) DMA transfer in the single-address mode is not supported.
3) DMA transfer in the dual-address mode supports the direct address transfer mode, but does not
support the indirect address transfer mode.
4) 16-byte DMA transfer in the dual-address mode is not supported.
5) The XINT signal asserts low active signal.
12
12....6
6
6 SH4 Mode
SH4 Mode
1) When the XRDY pin is low, it is in the ready state.
2) At DMA transfer in the single-address mode, transfer from the main memory (SH memory) to FIFO of
MINT can be performed, but transfer from MINT to the main memory cannot be performed.
3) DMA transfer in the single-address mode is performed in units of 32 bits or 32 bytes.
4) SH4-mode 32-byte DMA transfer in the dual-address mode supports inter-memory transfer, but does
not support transfer from memory to FIFO.
5) The XINT signal asserts low active signal.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MB86297APBH-GSE1 | IC GRAPHIC CTRLR 2/3D 543BGA |
| MB88F332ABPMC-GSE1 | IC GRAPHIC DISPLAY CTRLR 208LQFP |
| MC100E111FNR2 | IC CLK BUFFER 1:9 800MHZ 28-PLCC |
| MC100E210FNR2 | IC CLOCK BUFFER 1:4/1:5 28-PLCC |
| MC100E310FNR2 | IC CLOCK BUFFER MUX 2:8 28-PLCC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MB86277PMC-GS-BNDE1 | 制造商:FUJITSU 功能描述:CONTROLLER GRAPHIC MINT 256LQFP |
| MB86277PMCR-GS-BNDE1 | 制造商:FUJITSU 功能描述: |
| MB86290A | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:Graphics Controller Hardware Specifications |
| MB86290APVSR-G-BNDE1 | 制造商:FUJITSU 功能描述: |
| MB86291A | 制造商:Fujitsu 功能描述: |
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