參數(shù)資料
型號： MAX1329BETL+
廠商： Maxim Integrated Products
文件頁數(shù)： 2/78頁
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描述： IC DAS 12BIT 300KSPS 40-TQFN-EP
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 50
系列： *
MAX1329/MAX1330
12-/16-Bit DASs with ADC, DACs, DPIOs, APIOs,
Reference, Voltage Monitors, and Temp Sensor
10
______________________________________________________________________________________
TIMING CHARACTERISTICS
(DVDD = 1.8V to 3.6V, AVDD = 2.7V to 5.5V, TA = TMIN to TMAX, unless otherwise noted.)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
SERIAL-INTERFACE TIMING PARAMETERS (DVDD = 2.7V to 3.6V) (Figures 1 and 2)
SCLK Operating Frequency
f
OP
0
20
MHz
SCLK Cycle Time
t
CYC
50
ns
DIN to SCLK Setup
t
DS
15
ns
DIN to SCLK Hold
t
DH
0ns
SCLK Fall to Output Data Valid
t
DO
20
ns
CS Fall to Output Enable
t
DV
24
ns
CS Rise to Output Disable
t
TR
24
ns
CS to SCLK Rise Setup
t
CSS
15
ns
CS to SCLK Rise Hold
t
CSH
0ns
SCLK Pulse-Width High
t
CH
20
ns
SCLK Pulse-Width Low
t
CL
20
ns
SERIAL-INTERFACE TIMING PARAMETERS (DVDD = 1.8V to 3.6V) (Figures 1 and 2)
SCLK Operating Frequency
f
OP
0
10
MHz
SCLK Cycle Time
t
CYC
100
ns
DIN to SCLK Setup
t
DS
30
ns
DIN to SCLK Hold
t
DH
0ns
SCLK Fall to Output Data Valid
t
DO
40
ns
CS Fall to Output Enable
t
DV
48
ns
CS Rise to Output Disable
t
TR
48
ns
CS to SCLK Rise Setup
t
CSS
30
ns
CS to SCLK Rise Hold
t
CSH
0ns
SCLK Pulse-Width High
t
CH
40
ns
SCLK Pulse-Width Low
t
CL
40
ns
DIGITAL PROGRAMMABLE I/O TIMING PARAMETERS (DPIO1–DPIO4, DVDD = 2.7V to 3.6V, CL = 20pF)
SPI Write to DPIO Output Valid
t
SD
From last SCLK rising edge
50
ns
DPIO Rise/Fall Input to Interrupt
Asserted Delay
t
DI
Interrupt programmed on
RST1 and/or
RST2, corresponding status bits unmasked
55
ns
DPIO Input to Analog Block Delay
t
DA
When controlling ADC, DACs, or switches
40
ns
DIGITAL PROGRAMMABLE I/O TIMING PARAMETERS (DPIO1–DPIO4, DVDD = 1.8V to 3.6V, CL = 20pF)
SPI Write to DPIO Output Valid
t
SD
From last SCLK rising edge
100
ns
DPIO Rise/Fall Input to Interrupt
Asserted Delay
t
DI
Interrupt programmed on
RST1 and/or
RST2, corresponding status bits unmasked
150
ns
DPIO Input to Analog Block Delay
t
DA
When controlling ADC, DACs, or switches
50
ns
ANALOG PROGRAMMABLE I/O TIMING PARAMETERS (APIO1–APIO4, DVDD = 2.7V to 3.6V, AVDD = 2.7V to 5.5V, CL = 20pF)
SPI Write to APIO Output Valid
t
SD
From last SCLK rising edge
50
ns
APIO Rise/Fall Input to Interrupt
Asserted Delay
t
DI
Interrupt programmed on
RST1 and/or
RST2, corresponding status bits unmasked
50
ns
CS to APIO4 Propagation Delay
t
DCA
AP4MD<1:0> = 11
35
ns
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PDF描述
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MAX132CNG+ 功能描述:模數(shù)轉(zhuǎn)換器 - ADC 18-Bit .1ksps .545V Precision ADC RoHS:否 制造商:Texas Instruments 通道數(shù)量:2 結(jié)構(gòu):Sigma-Delta 轉(zhuǎn)換速率:125 SPs to 8 KSPs 分辨率:24 bit 輸入類型:Differential 信噪比:107 dB 接口類型:SPI 工作電源電壓:1.7 V to 3.6 V, 2.7 V to 5.25 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:VQFN-32
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