參數(shù)資料
型號(hào)： IDT72T36135ML5BBG
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 8/48頁
文件大?。?/td> 0K
描述： IC FIFO 1MX18 5NS 240BGA
標(biāo)準(zhǔn)包裝： 1
系列： 72T
功能： 異步，同步
存儲(chǔ)容量： 18M（1M x 18）
訪問時(shí)間： 5ns
電源電壓： 2.375 V ~ 2.625 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 240-BGA
供應(yīng)商設(shè)備封裝： 240-PBGA（19x19）
包裝： 托盤
其它名稱： 72T36135ML5BBG
COMMERCIAL AND INDUSTRIAL
TEMPERATURE RANGES
IDT72T36135M 2.5V 18M-BIT TeraSync
36-BIT FIFO
524,288 x 36
16
FEBRUARY 04, 2009
Figure 3. Programmable Flag Offset Programming Sequence
4666 drw
06
D/Q17
D/Q0
D/Q16
EMPTY OFFSET (LSB) REGISTER
Data Inputs/Outputs
# of Bits Used
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
Data Inputs/Outputs
16
1st Parallel Offset Write/Read Cycle
2nd Parallel Offset Write/Read Cycle
Data Inputs/Outputs
3rd Parallel Offset Write/Read Cycle
4th Parallel Offset Write/Read Cycle
FULL OFFSET (LSB) REGISTER
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
FULL OFFSET (MSB) REGISTER
17
18
D/Q17
D/Q0
D/Q16
D/Q17
D/Q
0
D/Q16
D/Q17
D/Q
0
D/Q16
6723 drw09
19
4666 drw
06
EMPTY OFFSET (MSB) REGISTER
17
18
19
NOTE:
1. Consecutive reads of the offset registers is not permitted. The read operation must be disabled for a minimum of
one RCLK cycle in between offset register accesses. (Please refer to Figure 21, Parallel Read of Programmable
Flag Registers (IDT Standard and FWFT Modes) for more details).
NOTES:
1. The programming method can only be selected at Master Reset.
2. Parallel reading of the offset registers is always permitted regardless of which programming method has been selected.
3. The programming sequence applies to both IDT Standard and FWFT modes.
WCLK
RCLK
X
XX
X
XX
LD
0
X
1
0
WEN
0
1
0
X
1
REN
1
0
1
X
0
1
1X
SEN
1
X
0
No Operation
Write Memory
Read Memory
No Operation
Parallel write to registers:
Empty Offset (LSB)
Empty Offset (MSB)
Full Offset (LSB)
Full Offset (MSB)
IDT72T36135M
Parallel read from registers:
Empty Offset (LSB)
Empty Offset (MSB)
Full Offset (LSB)
Full Offset (MSB)
Serial shift into registers:
Ending with Full Offset (MSB)
38 bits for the IDT72T36135M
1 bit for each rising SCLK edge
Starting with Empty Offset (LSB)
6723 drw08
SCLK
X
相關(guān)PDF資料
PDF描述
IDT72T72115L5BBI IC FIFO 131072X72 5NS 324-BGA
IDT72V06L15J IC ASYNCH 8192X18 15NS 32PLCC
IDT72V2105L15PFI IC FIFO SUPERSYNCII 15NS 64-TQFP
IDT72V2111L15PFI IC FIFO SS 512X9 15NS 64QFP
IDT72V2113L6BC IC FIFO SUPERSYNCII 6NS 100-BGA
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
IDT72T36135ML6BB 功能描述:IC FIFO 1MX18 6NS 240BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標(biāo)準(zhǔn)包裝:15 系列:74F 功能:異步 存儲(chǔ)容量:256（64 x 4） 數(shù)據(jù)速率:- 訪問時(shí)間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應(yīng)商設(shè)備封裝:24-PDIP 包裝:管件 其它名稱:74F433
IDT72T36135ML6BBI 制造商:Integrated Device Technology Inc 功能描述:IC FIFO 512KX36 ASYNC 240BGA
IDT72T3645L4-4BB 功能描述:IC FIFO 1024X36 4-4NS 208-BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標(biāo)準(zhǔn)包裝:90 系列:7200 功能:同步 存儲(chǔ)容量:288K（16K x 18） 數(shù)據(jù)速率:100MHz 訪問時(shí)間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應(yīng)商設(shè)備封裝:64-TQFP（14x14） 包裝:托盤 其它名稱:72271LA10PF
IDT72T3645L4-4BBG 功能描述:IC FIFO 1024X36 4-4NS 208-BGA RoHS:是 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標(biāo)準(zhǔn)包裝:90 系列:7200 功能:同步 存儲(chǔ)容量:288K（16K x 18） 數(shù)據(jù)速率:100MHz 訪問時(shí)間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應(yīng)商設(shè)備封裝:64-TQFP（14x14） 包裝:托盤 其它名稱:72271LA10PF
IDT72T3645L5BB 功能描述:IC FIFO 1024X36 5NS 208-BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標(biāo)準(zhǔn)包裝:90 系列:7200 功能:同步 存儲(chǔ)容量:288K（16K x 18） 數(shù)據(jù)速率:100MHz 訪問時(shí)間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應(yīng)商設(shè)備封裝:64-TQFP（14x14） 包裝:托盤 其它名稱:72271LA10PF
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