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參數(shù)資料
| 型號： | GMS30C7201 |
| 英文描述： | 32-Bit RISC Microprocessor(32位 RISC 微處理器) |
| 中文描述： | 32位RISC微處理器（32位的RISC微處理器） |
| 文件頁數(shù)： | 302/354頁 |
| 文件大?。?/td> | 1639K |
| 代理商： | GMS30C7201 |
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Slow AMBA Peripherals
13-72
GMS30C7201 Data Sheet
13.11.5AIC unit register description
Status Register (AICSR)
The Status Register shows the interrupt sources. When the AIC unit generates the
interrupt INTAIC to the CPU, the CPU first reads the status register of the AIC unit. INTS
bits of AICSR indicate which device generated the interrupt.
AIC Base + 0x70
AICBDR
Main and backup battery data register
RO
16
AIC Base + 0x80
AICTSTCR
Test control register
R/W
8
AIC Base + 0x84
AICTSTR0
This is a test register to allow the clock (ACLK) signal to
the ADC to be read back. This register is readable in
both normal mode and test mode.
RO
8
AIC Base + 0x88
AICTSTR1
This is a test register that provides 8-bit data (AD)
instead of the ADC output in AIC test mode.
R/W
8
AIC Base + 0x90
AICTSTR2
This is a test register to allow AIC output signals to the
ADC and to the interrupt controller to be read back
(INTAIC, AASN, AWRN, ARDN, AIOSTOP).
RO
8
AIC Base + 0x94
AICTSTR3
This is a test register to allow the AIC output signal to
the ADC and the touch panel to be read back (SWXN,
SWYN, SWXP, SWYP and AA).
RO
8
AIC Base + 0x98
AICTSTR4
This is a test register to allow the AIC output signal to
the ADC to be read back in AIC test mode (AD).
RO
8
AIC Base + 0xC0
ADCTSTR0
This register provides AA, AASN, AWRN, ARDN and
AIOSTOP values instead of the AIC output in ADC test
mode.
R/W
8
AIC Base + 0xC4
ADCTSTR1
This register provides AD values instead of the AIC
output in ADC test mode.
R/W
8
AIC Base + 0xD0
ADCTSTR2
This is a test register to allow the ADC output signal to
the AIC to be read back in ADC test mode.
RO
8
AIC Base + 0xD4
ADCTSTR3
This register provides ATEST and CALTEST values.
R/W
8
AIC Base + 0xD8
ADCTSTR4
This is a test register to allow the ADC output signal to
the AIC to be read back in ADC test mode (DATA,
OTR, PO and AIADN).
RO
16
AIC Base + 0xDC
TCLK
This register is used to generate TCLK in test mode.
Virtual
register
0
Address
Name
Description
R/W
Size
(bits)
Table 13-55: AIC unit register address map (Continued)
Bit
Initial
Name
Function
7
0
INTTPS
Interrupt touch panel status bit
6
0
INTMBS
Interrupt main battery status bit
Table 13-56: AICSR bit functions
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