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參數(shù)資料
| 型號： | FDC37B78X |
| 廠商： | STANDARD MICROSYSTEMS CORP |
| 元件分類： | 外設(shè)及接口 |
| 英文描述： | Enhanced Super I/O Controller with ACPI Support, Real Time Clock and Consumer IR |
| 中文描述： | MULTIFUNCTION PERIPHERAL, PQFP128 |
| 封裝： | QFP-128 |
| 文件頁數(shù)： | 159/258頁 |
| 文件大?。?/td> | 1091K |
| 代理商： | FDC37B78X |
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159
Power Management 1 Control Register 1 (PM1_CNTRL 1)
Register Location: <PM1_BLK>+4 System I/O Space
Default Value:00h on Vbat POR
Attribute:Read/Write (Note 0)
Size: 8-bits
BIT
0
NAME
SCI_EN
DESCRIPTION
When this bit is set, then the SCI enabled power management events will
generate an SCI interrupt. When this bit is reset power management
events will not generate an SCI interrupt.
Reserved. These bits always return a value of zero.
1-7
Reserved
Power Management 1 Control Register 2 (PM1_CNTRL 2)
Register Location: <PM1_BLK>+5 System I/O Space
Default Value:00h on Vbat POR
Attribute:Read/Write (Note 0)
Size: 8-bits
BIT
0
1
NAME
DESCRIPTION
Reserved
PWRBTNOR_E
N
Reserved. This field always returns zero.
This bit controls the power button over-ride function. When set, then
anytime the Button_In signal is asserted for more than four seconds
the system will transition to the off state. When a power button over-
ride event occurs, the logic should clear the PWRBTN_STS bit, and
set the PWRBTNOR_STS bit.
This 3-bit field defines the type of hardware sleep state the system
enters when the SLP_EN bit is set to one. When this field is 000 the
FDC37B78x will transition the machine to the off state when the
SLP_EN bit is set to one. That is, with this field set to 000, nPowerOn
will go inactive (float) after a 1-2 RTC clock delay when SLP_EN is
set. This delay is a minimum of one 32kHz clock and a maximum of
two 32kHz clocks (31.25
μ
sec-62.5
μ
sec). When this field is any other
value, there is no effect.
This is a write-only bit and reads to it always return a zero. Writing ‘1’
to this bit causes the system to sequence into the sleeping state
associated with the SLP_TYPx fields after a 1-2 RTC clock delay, if
the SLP_CTRL bit in the sleep / wake configuration register (0xF0 in
Logical Device A) is cleared. If the SLP_CTRL bit is set, do not
sequence into the sleeping state associated with the SLP_TYPx field,
but generate an SMI. Note: the SLP_EN_SMI bit in the SMI Status
Register 2 is always set upon writing ‘1’ to the SLP_EN bit. Writing ‘0’
to this bit has no effect.
Reserved. This field always returns zero.
2-4
SLP_TYPx
5
SLP_EN
6-7
Reserved
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| FDC37B80X | PC98/99 Compliant Enhanced Super I/O Controller with Keyboard/Mouse Wake-Up |
| FDC37C665IR | 3/5 Volt Advanced High-Performance Multi-Mode Parallel Port Super I/O Floppy Disk Controller with Infranred Support |
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| FDC37C666GT | High-Performance Multi-Mode Parallel Port Super I/O Floppy Disk Controllers |
| FDC37C67X | ENHANCED SUPER I/O CONTROLLER WITH FAST IR |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| FDC37B78X_07 | 制造商:SMSC 制造商全稱:SMSC 功能描述:Super I/O Controller with ACPI Support, Real Time Clock and Consumer IR |
| FDC37B802 | 制造商:Rochester Electronics LLC 功能描述: |
| FDC37B802QFP | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| FDC37B802QFP WAF | 制造商:SMSC 功能描述: |
| FDC37B807QFP | 制造商:SMSC 功能描述: |
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