參數(shù)資料
型號(hào)： DSPB56364AF100
廠商： Freescale Semiconductor
文件頁數(shù)： 100/148頁
文件大?。?/td> 0K
描述： IC DSP 24BIT AUD 100MHZ 100-LQFP
標(biāo)準(zhǔn)包裝： 90
系列： DSP56K/Symphony
類型： 音頻處理器
接口： 主機(jī)接口，I²C，SAI，SPI
時(shí)鐘速率： 100MHz
非易失內(nèi)存： ROM（24 kB）
芯片上RAM： 11.25kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 3.30V
工作溫度： -40°C ~ 105°C
安裝類型： 表面貼裝
封裝/外殼： 100-LQFP
供應(yīng)商設(shè)備封裝： 100-LQFP（14x14）
包裝： 托盤
Serial Host Interface SPI Protocol Timing
DSP56364 Technical Data, Rev. 4.1
Freescale Semiconductor
3-39
152
SCK edge to data out valid
(data out delay time)
Master/
Slave
Bypassed
2
×T
C+33
—
53
ns
Narrow
2
×T
C+123
—
143
ns
Wide
2
×T
C+210
—
230
ns
153
SCK edge to data out not valid
(data out hold time)
Master/
Slave
Bypassed
TC+5
15
—
ns
Narrow
TC+55
65
—
ns
Wide
TC+106
116
—
ns
154
SS assertion to data out valid
(CPHA = 0)
Slave
—
TC+33
—
43
ns
157
First SCK sampling edge to HREQ output
deassertion
Slave
Bypassed
2.5
×T
C+30
—
55
ns
Narrow
2.5
×T
C+120
—
145
ns
Wide
2.5
×T
C+217
—
242
ns
158
Last SCK sampling edge to HREQ output not
deasserted (CPHA = 1)
Slave
Bypassed
2.5
×T
C+30
55
—
ns
Narrow
2.5
×T
C+80
105
—
ns
Wide
2.5
×T
C+136
161
—
ns
159
SS deassertion to HREQ output not deasserted
(CPHA = 0)
Slave
—
2.5
×T
C+30
55
—
ns
160
SS deassertion pulse width (CPHA = 0)
Slave
—
TC+6
16
—
ns
161
HREQ in assertion to first SCK edge
Master
Bypassed
0.5
× t
SPICC +
2.5
×T
C+43
121
—
ns
Narrow
0.5
×t
SPICC +
2.5
×T
C+43
174
—
ns
Wide
0.5
×t
SPICC +
2.5
×T
C+43
209
—
ns
162
HREQ in deassertion to last SCK sampling
edge (HREQ in set-up time) (CPHA = 1)
Master
—
0
—
ns
163
First SCK edge to HREQ in not asserted
(HREQ in hold time)
Master
—
0
—
ns
Note: Periodically sampled, not 100% tested
Table 3-17 Serial Host Interface SPI Protocol Timing (continued)
No.
Characteristics
Mode
Filter
Mode
Expression
Min
Max
Unit
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