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參數(shù)資料
| 型號： | DP83848HSQ/NOPB |
| 廠商： | National Semiconductor |
| 文件頁數(shù)： | 75/82頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC TXRX ETHERNET PHYTER 40-LLP |
| 產(chǎn)品培訓模塊： | PHYTER® Family |
| 標準包裝： | 1 |
| 類型： | 收發(fā)器 |
| 驅(qū)動器/接收器數(shù)： | 1/1 |
| 規(guī)程： | 以太網(wǎng) |
| 電源電壓： | 3 V ~ 3.6 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 40-WFQFN 裸露焊盤 |
| 供應商設備封裝： | 40-LLP-EP（6x6） |
| 包裝： | 剪切帶 (CT) |
| 配用： | DP83848H-MAU-EK-ND - BOARD EVALUATION DP83848H |
| 其它名稱： | *DP83848HSQ/NOPB DP83848HSQCT |
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www.national.com
76
DP
83
848
H
8.2.25 RMII Receive Timing
Note: Per the RMII Specification, output delays assume a 25pF load.
Note: CRS_DV is asserted asynchronously in order to minimize latency of control signals through the Phy. CRS_DV may
toggle synchronously at the end of the packet to indicate CRS deassertion.
Note: RX_DV is synchronous to X1. While not part of the RMII specification, this signal is provided to simplify recovery of
receive data.
Note: CRS ON delay is measured from the first bit of the JK symbol on the PMD Input Pair to initial assertion of CRS_DV.
Note: CRS OFF delay is measured from the first bit of the TR symbol on the PMD Input Pair to initial de-assertion of
CRS_DV.
Note: Receive Latency is measured from the first bit of the symbol pair on the PMD Input Pair. Typical values are with the
Elasticity Buffer set to the default value (01).
Parameter
Description
Notes
Min
Typ
Max
Units
T2.25.1
X1 Clock Period
50 MHz Reference Clock
20
ns
T2.25.2
RXD[1:0], CRS_DV, RX_DV,
and RX_ER output delay from
X1 rising
214
ns
T2.25.3
CRS ON delay
From JK symbol on PMD Receive Pair to
initial assertion of CRS_DV
18.5
bits
T2.25.4
CRS OFF delay
From TR symbol on PMD Receive Pair to
initial deassertion of CRS_DV
27
bits
T2.25.5
RXD[1:0] and RX_ER latency
From symbol on Receive Pair. Elasticity
buffer set to default value (01)
38
bits
CRS_DV
X1
RXD[1:0]
RX_ER
PMD Input Pair
IDLE
Data
(J/K)
Data
(TR)
RX_DV
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PDF描述 |
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