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參數(shù)資料
| 型號： | COP8CDR9LVA8 |
| 廠商： | National Semiconductor |
| 文件頁數(shù)： | 52/111頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU CMOS 8BIT 68-PLCC |
| 標(biāo)準(zhǔn)包裝： | 18 |
| 系列： | COP8™ 8C |
| 核心處理器： | COP8 |
| 芯體尺寸： | 8-位 |
| 速度： | 20MHz |
| 連通性： | Microwire/Plus（SPI），UART/USART |
| 外圍設(shè)備： | POR，PWM，WDT |
| 輸入/輸出數(shù)： | 59 |
| 程序存儲器容量： | 32KB（32K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 1K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 16x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 68-LCC（J 形引線） |
| 包裝： | 管件 |
| 其它名稱： | *COP8CDR9LVA8 |
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SNOS535I – OCTOBER 2000 – REVISED MARCH 2013
The underflows can be programmed to toggle the TxA output pin. The underflows can also be
programmed to generate interrupts.
Underflows from the timer are alternately latched into two pending flags, TxPNDA and TxPNDB. The user
must reset these pending flags under software control. Two control enable flags, TxENA and TxENB,
allow the interrupts from the timer underflow to be enabled or disabled. Setting the timer enable flag
TxENA will cause an interrupt when a timer underflow causes the RxA register to be reloaded into the
timer. Setting the timer enable flag TxENB will cause an interrupt when a timer underflow causes the RxB
register to be reloaded into the timer. Resetting the timer enable flags will disable the associated
interrupts.
Either or both of the timer underflow interrupts may be enabled. This gives the user the flexibility of
interrupting once per PWM period on either the rising or falling edge of the PWM output. Alternatively, the
user may choose to interrupt on both edges of the PWM output.
Figure 5-10. Timer in PWM Mode
5.11.2.3 Mode 2. External Event Counter Mode
This mode is quite similar to the processor independent PWM mode described above. The main difference
is that the timer, Tx, is clocked by the input signal from the TxA pin after synchronization to the
appropriate internal clock (tC or MCLK). The Tx timer control bits, TxC3, TxC2 and TxC1 allow the timer to
be clocked either on a positive or negative edge from the TxA pin. Underflows from the timer are latched
into the TxPNDA pending flag. Setting the TxENA control flag will cause an interrupt when the timer
underflows.
In this mode the input pin TxB can be used as an independent positive edge sensitive interrupt input if the
TxENB control flag is set. The occurrence of a positive edge on the TxB input pin is latched into the
TxPNDB flag.
Figure 5-11 shows a block diagram of the timer in External Event Counter mode.
NOTE
The PWM output is not available in this mode since the TxA pin is being used as the counter
input clock.
Copyright 2000–2013, Texas Instruments Incorporated
Functional Description
45
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| C8051F583-IQ | IC 8051 MCU 128K FLASH 32-QFP |
| 67068-0000 | CONN USB RT ANG RECPT TYPE B BLK |
| P89LPC952FBD,157 | IC 80C51 MCU FLASH 8K 44-LQFD |
| LPC11C22FBD48/301, | IC MCU 32BIT 16KB FLASH 48LQFP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| COP8CFE9HVA9/NOPB | 功能描述:IC MCU EEPROM 8BIT 8K 44-PLCC RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:COP8™ 8C 標(biāo)準(zhǔn)包裝:250 系列:56F8xxx 核心處理器:56800E 芯體尺寸:16-位 速度:60MHz 連通性:CAN，SCI，SPI 外圍設(shè)備:POR，PWM，溫度傳感器，WDT 輸入/輸出數(shù):21 程序存儲器容量:40KB（20K x 16） 程序存儲器類型:閃存 EEPROM 大小:- RAM 容量:6K x 16 電壓 - 電源 (Vcc/Vdd):2.25 V ~ 3.6 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 6x12b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 125°C 封裝/外殼:48-LQFP 包裝:托盤 配用:MC56F8323EVME-ND - BOARD EVALUATION MC56F8323 |
| COP8CFE9IMT9/NOPB | 功能描述:IC MCU EEPROM 8BIT 8K 48-TSSOP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:COP8™ 8C 標(biāo)準(zhǔn)包裝:250 系列:56F8xxx 核心處理器:56800E 芯體尺寸:16-位 速度:60MHz 連通性:CAN，SCI，SPI 外圍設(shè)備:POR，PWM，溫度傳感器，WDT 輸入/輸出數(shù):21 程序存儲器容量:40KB（20K x 16） 程序存儲器類型:閃存 EEPROM 大小:- RAM 容量:6K x 16 電壓 - 電源 (Vcc/Vdd):2.25 V ~ 3.6 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 6x12b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 125°C 封裝/外殼:48-LQFP 包裝:托盤 配用:MC56F8323EVME-ND - BOARD EVALUATION MC56F8323 |
| COP8CJ20 WAF | 制造商:Texas Instruments 功能描述: |
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