
Brooktree
iii
L261_H
Bt261
30 MHz Pixel Clock Monolithic CMOS HSYNC Line Lock Controller
T
ABLE
OF
C
ONTENTS
List of Figures
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . v
List of Tables
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . vi
Circuit Description
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3
MPU Interface
Video Input / Sync Detector
Horizontal Counter
Horizontal Sync Separation
HSYNC Input/Output
VSYNC* Output
FIELD Output
CLAMP and ZERO Outputs
Capture Output
External VCO Pixel Clock Generation
Phase/Frequency Detector Operation
Two Forms of Noise Gating Available
The Status Registers SR00 and SR05 Used in Automatic Phase Limiting
Asynchronous (Unlocked) Pixel Clock Generation
Pin Descriptions
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. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3
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Internal Registers
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Horizontal Counter
Command Register_0
Command Register_1
Command Register_2
Command Register_3
VSYNC Sample Register
OSC Count Low and High Registers
Status Register
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25
HSYNC Start and Stop Registers
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28
CLAMP Start and Stop Registers
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29
ZERO Start and Stop Registers
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30
FIELD Gate Start and Stop Registers
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31
Noise Gate Start and Stop Registers
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21
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