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參數(shù)資料
| 型號： | ADUC7122BBCZ-RL |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 46/96頁 |
| 文件大?。?/td> | 0K |
| 描述： | PRECISION ANALOG MCU I.C |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | MicroConverter® ADuC7xxx |
| 核心處理器： | ARM7 |
| 芯體尺寸： | 16/32-位 |
| 速度： | 41.78MHz |
| 連通性： | I²C，SPI，UART/USART |
| 外圍設(shè)備： | POR，PWM，WDT |
| 輸入/輸出數(shù)： | 32 |
| 程序存儲器容量： | 126KB（63K x 16） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 8K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 13x12b，D/A 12x12b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -10°C ~ 95°C |
| 封裝/外殼： | 108-LFBGA，CSPBGA |
| 包裝： | 標(biāo)準(zhǔn)包裝 |
| 其它名稱： | ADUC7122BBCZ-RLDKR |
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ADuC7122
Rev. 0 | Page 50 of 96
Bit
Name
Description
8:6
PWMCP[2:0]
PWM clock prescaler bits. Sets the UCLK divider.
000 = UCLK/2.
001 = UCLK/4.
010 = UCLK/8.
011 = UCLK/16.
100 = UCLK/32.
101 = UCLK/64.
110 = UCLK/128.
111 = UCLK/256.
5
POINV
Set to 1 by the user to invert all PWM outputs.
Cleared by the user to use PWM outputs as normal.
4
HOFF
High-side off.
Set to 1 by the user to force PWM1 and PWM3 outputs high. This also forces PWM2 and PWM4 low.
Cleared by the user to use the PWM outputs as normal.
3
LCOMP
Load compare registers.
Set to 1 by the user to load the internal compare registers with the values in PWMxCOMx on the next transition of the
PWM timer from 0x00 to 0x01.
Cleared by the user to use the values previously stored in the internal compare registers.
2
DIR
Direction control.
Set to 1 by the user to enable PWM1 and PWM2 as the output signals while PWM3 and PWM4 are held low.
Cleared by the user to enable PWM3 and PWM4 as the output signals while PWM1 and PWM2 are held low.
1
HMODE
Enables H-bridge mode.
Set to 1 by the user to enable H-Bridge mode and Bit 1 to Bit 5 of PWMCON1.
Cleared by the user to operate the PWMs in standard mode.
0
PWMEN
Set to 1 by the user to enable all PWM outputs.
Cleared by the user to disable all PWM outputs.
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PDF描述 |
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