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參數(shù)資料
| 型號： | ADAU1461WBCPZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 67/88頁 |
| 文件大小： | 0K |
| 描述： | IC SIGMADSP 24BIT 96KHZ PLL 32 |
| 標準包裝： | 1 |
| 系列： | SigmaDSP® |
| 類型： | 音頻處理器 |
| 應用： | 車載音頻 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-VFQFN 裸露焊盤，CSP |
| 供應商設備封裝： | 32-LFCSP-VQ |
| 包裝： | 托盤 |
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ADAU1461
Rev. 0 | Page 7 of 88
Parameter
Test Conditions/Comments
Min
Typ
Max
Unit
Interchannel Gain Mismatch
0.3
+0.3
dB
Offset Error
22
+22
mV
Gain Error
10
+10
%
DAC TO HEADPHONE/EARPIECE
OUTPUT
LOUTx, ROUTx, LHP, RHP in headphone
output mode; PO = output power per
channel
Total Harmonic Distortion + Noise
Capless Headphone Mode
2 dBFS, 16 Ω load
61
dB
2 dBFS, 32 Ω load
63
dB
Headphone Output Mode
0 dBFS, 10 kΩ load
76
dB
REFERENCE
Common-Mode Reference Output
CM pin
1.47
1.83
V
POWER SUPPLY SPECIFICATIONS
Master clock = 12.288 MHz, input sample rate = 48 kHz, input tone = 1 kHz, ADC input @ 1 dBFS, DAC input @ 0 dBFS,
40°C < TA < +105°C, IOVDD = 3.3 V ± 10%. For total power consumption, add the IOVDD current listed in Table 3.
Table 3.
Parameter
Test Conditions/Comments
Min
Typ
Max
Unit
SUPPLIES
Voltage
DVDDOUT
1.56
V
AVDD
2.97
3.3
3.65
V
IOVDD
2.97
3.3
3.65
V
Digital I/O Current (IOVDD)
20 pF capacitive load on all digital pins
Slave Mode
fS = 48 kHz
0.48
mA
fS = 96 kHz
0.9
mA
fS = 8 kHz
0.13
mA
Master Mode
fS = 48 kHz
1.51
mA
fS = 96 kHz
3
mA
fS = 8 kHz
0.27
mA
Analog Current (AVDD)
Record Stereo Differential to ADC
PLL bypass
5.24
mA
Integer PLL
6.57
mA
DAC Stereo Playback to Line Output
10 kΩ load
PLL bypass
5.55
mA
Integer PLL
6.90
mA
DAC Stereo Playback to Headphone
32 Ω load
PLL bypass
30.9
mA
Integer PLL
32.25
mA
DAC Stereo Playback to Capless Headphone
32 Ω load
PLL bypass
56.75
mA
Integer PLL
58
mA
相關PDF資料 |
PDF描述 |
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| VI-B6M-MY | CONVERTER MOD DC/DC 10V 50W |
| VI-B6H-MY | CONVERTER MOD DC/DC 52V 50W |
| VI-B6F-MY | CONVERTER MOD DC/DC 72V 50W |
相關代理商/技術參數(shù) |
參數(shù)描述 |
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