參數(shù)資料
型號(hào)： ADAU1461WBCPZ
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 58/88頁(yè)
文件大?。?/td> 0K
描述： IC SIGMADSP 24BIT 96KHZ PLL 32
標(biāo)準(zhǔn)包裝： 1
系列： SigmaDSP®
類(lèi)型： 音頻處理器
應(yīng)用： 車(chē)載音頻
安裝類(lèi)型： 表面貼裝
封裝/外殼： 32-VFQFN 裸露焊盤(pán)，CSP
供應(yīng)商設(shè)備封裝： 32-LFCSP-VQ
包裝： 托盤(pán)
ADAU1461
Rev. 0 | Page 61 of 88
R16: Serial Port Control 1, 16,406 (0x4016)
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
BPF[2:0]
ADTDM
DATDM
MSBP
LRDEL[1:0]
Table 48. Serial Port Control 1 Register
Bits
Bit Name
Description
[7:5]
BPF[2:0]
Number of bit clock cycles per LRCLK audio frame.
Setting
Bit Clock Cycles
000
64 (default)
001
Reserved
010
48
011
128
100
256
101
Reserved
110
Reserved
111
Reserved
4
ADTDM
ADC serial audio data channel position in TDM mode.
0 = left first (default).
1 = right first.
3
DATDM
DAC serial audio data channel position in TDM mode.
0 = left first (default).
1 = right first.
2
MSBP
MSB position in the LRCLK frame.
0 = MSB first (default).
1 = LSB first.
[1:0]
LRDEL[1:0]
Data delay from LRCLK edge (in BCLK units).
Setting
Delay (Bit Clock Cycles)
00
1 (default)
01
0
10
8
11
16
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PDF描述
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參數(shù)描述
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