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參數(shù)資料
| 型號： | AD9948KCPZRL |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 12/28頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CCD SIGNAL PROCESSOR 40-LFCSP |
| 標準包裝： | 2,500 |
| 類型： | CCD 信號處理器，10 位 |
| 輸入類型： | 邏輯 |
| 輸出類型： | 邏輯 |
| 接口： | 3 線串口 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 40-VFQFN 裸露焊盤，CSP |
| 供應商設備封裝： | 40-LFCSP |
| 包裝： | 帶卷 (TR) |
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REV. 0
–2–
AD9948–SPECIFICATIONS
DIGITAL SPECIFICATIONS
Parameter
Symbol
Min
Typ
Max
Unit
LOGIC INPUTS
High Level Input Voltage
VIH
2.1
V
Low Level Input Voltage
VIL
0.6
V
High Level Input Current
IIH
10
A
Low Level Input Current
IIL
10
A
Input Capacitance
CIN
10
pF
LOGIC OUTPUTS
High Level Output Voltage, IOH = 2 mA
VOH
2.2
V
Low Level Output Voltage, IOL = 2 mA
VOL
0.5
V
CLI INPUT
High Level Input Voltage
(TCVDD/2 + 0.5 V)
VIH–CLI
1.85
V
Low Level Input Voltage
VIL–CLI
0.85
V
RG AND H-DRIVER OUTPUTS
High Level Output Voltage
(RGVDD – 0.5 V and HVDD – 0.5 V)
VOH
2.2
V
Low Level Output Voltage
VOL
0.5
V
Maximum Output Current (Programmable)
30
mA
Maximum Load Capacitance
100
pF
Specifications subject to change without notice.
GENERAL SPECIFICATIONS
Parameter
Min
Typ
Max
Unit
TEMPERATURE RANGE
Operating
–20
+85
°C
Storage
–65
+150
°C
MAXIMUM CLOCK RATE
25
MHz
POWER SUPPLY VOLTAGE
AVDD, TCVDD (AFE, Timing Core)
2.7
3.0
3.6
V
HVDD (H1–H4 Drivers)
2.7
3.0
3.6
V
RGVDD (RG Driver)
2.7
3.0
3.6
V
DRVDD (D0–D9 Drivers)
2.7
3.0
3.6
V
DVDD (All Other Digital)
2.7
3.0
3.6
V
POWER DISSIPATION
25 MHz, HVDD = RGVDD = 3 V, 100 pF H1–H4 Loading
*
220
mW
Total Shutdown Mode
1
mW
*The total power dissipated by the HVDD supply may be approximated using the equation
Total HVDD Power
C
HVDD
Pixel Frequency
HVDD
Number of H
Outputs Used
LOAD
=×
×
()
(
)
Reducing the H-loading, using only two of the outputs, and/or using a lower HVDD supply will reduce the power dissipation.
Specifications subject to change without notice.
(TMIN to TMAX, AVDD = DVDD = DRVDD = HVDD = RGVDD = 2.7 V, CL = 20 pF, unless otherwise noted.)
相關PDF資料 |
PDF描述 |
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