SCLK DON'T CARE SDIO A12 W0 W1 R/W A11 A10 A9 A8" />
參數(shù)資料
型號: AD9552BCPZ-REEL7
廠商: Analog Devices Inc
文件頁數(shù): 15/32頁
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描述: IC PLL CLOCK GEN LP 32LFCSP
設計資源: Clock Distribution Circuit with Pin-Programmable Output Frequency, Output Logic Levels, and Fanout (CN0152)
標準包裝: 1,500
類型: 時鐘發(fā)生器
PLL: 帶旁路
輸入: 時鐘,晶體
輸出: CMOS,LVDS,LVPECL
電路數(shù): 1
比率 - 輸入:輸出: 2:2
差分 - 輸入:輸出: 無/是
頻率 - 最大: 900MHz
除法器/乘法器: 是/無
電源電壓: 3.3V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 32-VFQFN 裸露焊盤,CSP
供應商設備封裝: 32-LFCSP-VQ(5x5)
包裝: 帶卷 (TR)
AD9552
Data Sheet
Rev. E | Page 22 of 32
07806-
008
CS
SCLK DON'T CARE
SDIO
A12
W0
W1
R/W
A11 A10 A9
A8
A7
A6 A5
A4
A3 A2
A1
A0
D7 D6
D5
D4
D3
D2 D1
D0
D7
D6 D5
D4
D3 D2
D1
D0
DON'T CARE
16-BIT INSTRUCTION HEADER
REGISTER (N) DATA
REGISTER (N – 1) DATA
Figure 24. Serial Control Port Write—MSB First, 16-Bit Instruction, Two Bytes Data
07806-
009
CS
SCLK
SDIO
REGISTER (N) DATA
16-BIT INSTRUCTION HEADER
REGISTER (N – 1) DATA
REGISTER (N – 2) DATA
REGISTER (N – 3) DATA
A12
W0
W1
R/W
A11 A10 A9 A8 A7 A6 A5 A4 A3 A2 A1 A0
DON'T CARE
D7 D6 D5 D4 D3 D2 D1 D0 D7 D6 D5 D4 D3 D2 D1 D0 D7 D6 D5 D4 D3 D2 D1 D0 D7 D6 D5 D4 D3 D2 D1 D0
Figure 25. Serial Control Port Read—MSB First, 16-Bit Instruction, Four Bytes Data
07806-
010
tS
DON'T CARE
W1
W0
A12
A11
A10
A9
A8
A7
A6
A5
D4
D3
D2
D1
D0
DON'T CARE
R/W
tDS
tDH
tHIGH
tLOW
tCLK
tH
CS
SCLK
SDIO
Figure 26. Serial Control Port Write—MSB First, 16-Bit Instruction, Timing Measurements
07806-
0
1
DATA BIT N – 1
DATA BIT N
CS
SCLK
SDIO
tDV
Figure 27. Timing Diagram for Serial Control Port Register Read
07806-
012
CS
SCLK DON'T CARE
DON'T CARE
16-BIT INSTRUCTION HEADER
REGISTER (N) DATA
REGISTER (N + 1) DATA
SDIO
DON'T CARE
A0 A1 A2
A3
A4
A5 A6
A7
A8
A9 A10 A11 A12
D1
D0
R/W
W1
W0
D2
D3
D4
D5 D6
D7
D0
D1 D2
D3
D4 D5
D6
D7
Figure 28. Serial Control Port Write—LSB First, 16-Bit Instruction, Two Bytes Data
07806-
013
SCLK
SDIO
tHIGH
tLOW
tCLK
tS
tDS
tDH
tH
BIT N
BIT N + 1
CS
Figure 29. Serial Control Port Timing—Write
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PDF描述
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