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參數(shù)資料
| 型號： | AD9522-4BCPZ-REEL7 |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 時鐘產生/分配 |
| 英文描述： | OTHER CLOCK GENERATOR, QCC64 |
| 封裝： | 9 X 9 MM, ROHS COMPLIANT, MO-220VMMD-4, LFCSP-64 |
| 文件頁數(shù)： | 48/84頁 |
| 文件大小： | 1606K |
| 代理商： | AD9522-4BCPZ-REEL7 |
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AD9522-4
Rev. 0 | Page 52 of 84
Data Transfer Format
Send byte format—the send byte protocol is used to set up the register address for subsequent commands.
S
Slave Address
W
A
RAM Address High Byte
A
RAM Address Low Byte
A
P
Write byte format—the write byte protocol is used to write a register address to the RAM starting from the specified RAM address.
S
Slave Address
W
A
RAM Address
High Byte
A
RAM Address
Low Byte
A
RAM Data 0
A
RAM Data 1
A
RAM Data 2
A
P
Receive byte format—the receive byte protocol is used to read the data byte(s) from RAM starting from the current address.
S
Slave Address
R
A
RAM Data 0
A
RAM Data 1
A
RAM Data 2
A
P
Read byte format—the combined format of the send byte and the receive byte.
S
Slave
Address
W
A
RAM Address
High Byte
A
RAM Address
Low Byte
A
Sr
Slave
Address
R
A
RAM
Data 0
A
RAM
Data 1
A
RAM
Data 2
A
P
IC Serial Port Timing
SDA
SCL
S
Sr
P
S
tFALL
tSET; DAT
tLOW
tRISE
tHLD; STR
tHLD; DAT
tHIGH
tFALL
tSET; STR
tHLD; STR
tSPIKE
tSET; STP
tRISE
tIDLE
07
22
5
-16
5
Figure 61. IC Serial Port Timing
Table 41. I2C Timing Definitions
Parameter
Description
fI2C
IC clock frequency
tIDLE
Bus idle time between stop and start conditions
tHLD; STR
Hold time for repeated start condition
tSET; STR
Setup time for repeated start condition
tSET; STP
Setup time for stop condition
tHLD; DAT
Hold time for data
tSET; DAT
Setup time for data
tLOW
Duration of SCL clock low
tHIGH
Duration of SCL clock high
tRISE
SCL/SDA rise time
tFALL
SCL/SDA fall time
tSPIKE
Voltage spike pulse width that must be suppressed by the input filter
相關PDF資料 |
PDF描述 |
|---|---|
| AD9522-4BCPZ | OTHER CLOCK GENERATOR, QCC64 |
| AD9575ARUZLVD | Network Clock Generator, Two Outputs, TSSOP 4.4 MM, No of Pins: 16 |
| AD9575ARUZPEC | Network Clock Generator, Two Outputs, TSSOP 4.4 MM, No of Pins: 16 |
| ADC-10-4-75R+ | 5 MHz - 1000 MHz RF/MICROWAVE DIRECTIONAL COUPLER, 1.8 dB INSERTION LOSS-MAX |
| ADC1113D125HN | Dual 11 bits ADC; 125 Msps; serial JESD204A |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| AD9523 | 制造商:AD 制造商全稱:Analog Devices 功能描述:Jitter Cleaner and Clock Generator with 14 Differential or 29 LVCMOS Outputs |
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