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參數(shù)資料
| 型號(hào)： | 935278155557 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 消費(fèi)家電 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PBGA456 |
| 封裝： | 27 X 27 MM, 1.75 MM HIEGHT, PLASTIC, MS-034, BGA-456 |
| 文件頁數(shù)： | 409/828頁 |
| 文件大?。?/td> | 7748K |
| 代理商： | 935278155557 |
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Philips Semiconductors
PNX15xx Series
Volume 1 of 1
Chapter 13: FGPO: Fast General Purpose Output
PNX15XX_SER_3
Koninklijke Philips Electronics N.V. 2006. All rights reserved.
Product data sheet
Rev. 3 — 17 March 2006
13-6
2.1 Reset
FGPO is reset by any PNX15xx Series system reset or by setting the
SOFTWARE_RESET bit FGPO_SOFT_RST register.
Remark: SOFTWARE_RESET does not reset MMIO bus interface registers. Any
DMA transfers will be aborted during a SOFTWARE_RESET. All registers reset to the
Reset Value shown in the Register Description section.
2.2 Base Addresses
Two base address registers are used to point to main memory buffers in a double
buffering scheme. Addresses are forced into 32-bit address alignment.
2.3 Sample (data) Size
Data size (width) per sample is set to either 8, 16, or 32-bit using
FGPO_CTL.DATA_SIZE bit eld. For 8-bit samples, four samples are packed into one
32-bit word. For 16-bit samples, two samples are packed 2 into one 32-bit word.
Packed data is read from memory in full 32-bit words.
Byte order, with which the data is read from memory, is controlled by the global
PNX15xx Series endian mode. The endian state only affects 16 and 32-bit sample
sizes.
fgpo_stop
or
fgpo_buf_start
output
To External PAD VDO_D[33] via Output Router.
Message Passing Mode:
A programmable pulse on fgpo_stop indicates the end of a message. This pulse may be
programmed to be a one clock pulse concurrent with the last data sample, or a pulse lasting
as long as valid data samples are output.
Record Capture Mode:
A programmable pulse on fgpo_buf_start indicates the start of a new buffer. The pulse may
be programmed to occur one clock before or at the same clock with the rst valid data sample
for the buffer
or
A positive pulse lasting as long as each buffer is active.
or
A positive pulse lasting as long as buffer 2 is active.
fgpo_data
output
To External PAD VDO_D[31:0] via Output Router.
General Purpose high speed sample data output changing on each active edge of clk_fgpo.
In 8-bit mode data is placed on fgpo_data7:0]. In 16-bit mode data is placed on
fgpo_data[15:0].
fgpo_interrupt
output
Interrupt status connects to the TriMedia Processor in the PNX15xx Series.
Table 1: Module signal pins …Continued
Signal
Type
Description
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 935278338557 | SPECIALTY CONSUMER CIRCUIT, PBGA456 |
| 935279245557 | SPECIALTY CONSUMER CIRCUIT, PBGA456 |
| 935274728557 | SPECIALTY CONSUMER CIRCUIT, PBGA456 |
| 935277747557 | SPECIALTY CONSUMER CIRCUIT, PBGA456 |
| 935272905557 | SPECIALTY CONSUMER CIRCUIT, PBGA456 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 935278818112 | 制造商:NXP Semiconductors 功能描述:LCD DRVR 20DIGIT 2.5V/3.3V/5V 56-Pin VSO Tube |
| 935280517132 | 制造商:NXP Semiconductors 功能描述:IC TRANSLATING BUFFER 6XSON |
| 935281751112 | 制造商:NXP Semiconductors 功能描述:IC BUFFER/DVR 16BIT 3ST 48TSSOP |
| 935281751118 | 制造商:NXP Semiconductors 功能描述:IC BUFFER/DVR 16BIT 3ST 48TSSOP |
| 935281753112 | 制造商:NXP Semiconductors 功能描述:IC TXRX 16BIT 3.3V 3ST 48TSSOP |
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