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參數(shù)資料
| 型號： | XS1-G02B-FB144-I4 |
| 廠商： | XMOS |
| 文件頁數(shù)： | 10/24頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 32BIT 16KB OTP 144FBGA |
| 標準包裝： | 176 |
| 系列： | XS1 |
| 核心處理器： | XCore |
| 芯體尺寸： | 32 位雙核 |
| 速度： | 400MHz |
| 連通性： | USB |
| 輸入/輸出數(shù)： | 88 |
| 程序存儲器容量： | 16KB（4K x 32） |
| 程序存儲器類型： | OTP |
| RAM 容量： | 32K x 32 |
| 電壓 - 電源 (Vcc/Vdd)： | 0.95 V ~ 3.6 V |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 144-FBGA |
| 包裝： | 托盤 |
| 其它名稱： | 880-1007 |
XS1-G02B-FB144 Datasheet
17
6.8
XCore I/O AC Characteristics
Symbol
Parameter
MIN TYP MAX UNITS
Notes
T(XOVALID)
Input data valid window
8
ns
T(XOINVALID)
Output data invalid window
9
ns
T(XIFMAX)
Rate at which data can be sampled
with respect to an external clock
60
MHz
Figure 16:
I/O AC char-
acteristics
The input valid window parameter relates to the capability of the device to capture
data input to the chip with respect to an external clock source. It is calculated as the
sum of the input setup time and input hold time with respect to the external clock
as measured at the pins. The output invalid window species the time for which
an output is invalid with respect to the external clock. Note that these parameters
are specied as a window rather than absolute numbers since the device provides
functionality to delay the incoming clock with respect to the incoming data.
Information on interfacing to high-speed synchronous interfaces can be found in
the XS1 Port I/O Timing document, document number X9122.
6.9
XMOS Link Performance
Symbol
Parameter
MIN
TYP
MAX
UNITS
Notes
B(2blinkP)
2b link bandwidth (packetized)
87
MBit/s
A, B
B(5blinkP)
5b link bandwidth (packetized)
217
MBit/s
A, B
B(2blinkS)
2b link bandwidth (streaming)
100
MBit/s
B
B(5blinkS)
5b link bandwidth (streaming)
250
MBit/s
B
Figure 17:
Link
performance
A Assumes 32-byte packet in 3-byte header mode. Actual performance depends on size of the header
and payload.
B 7.5 ns symbol time.
The asynchronous nature of links means that the relative phasing of SS_CLK clocks
is not important in a multi-clock system, providing each meets the required stability
criteria.
6.10
JTAG Timing
Symbol
Parameter
MIN
TYP
MAX
UNITS
Notes
T(TCK)
TCK period
30
ns
T(SETUP)
TDO to TCK setup time
5
ns
A
T(HOLD)
TDO to TCK hold time
10
ns
A
T(DELAY)
TCK to output delay
15
ns
B
Figure 18:
JTAG timing
A Timing applies to SS_TMS, SS_TRST and SS_TDI inputs.
B Timing applies to SS_TDO output.
Document Number: 1100C
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參數(shù)描述 |
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