參數(shù)資料
型號： XRT79L71IB
廠商： EXAR CORP
元件分類： 數(shù)字傳輸電路
英文描述： 1 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC
中文描述： ATM NETWORK INTERFACE, PBGA208
封裝： 17 X 17 MM, STBGA-208
文件頁數(shù)： 262/441頁
文件大小： 4346K
代理商： XRT79L71IB
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XRT79L71
REV. P1.0.3
PRELIMINARY
1 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC
á
250
6
HEC Status into UDF2
Enable
R/W
HEC Status into UDF2 Byte Enable:
This READ/WRITE bit-field permits the user to configure the
Receive ATM Cell Processor block to insert the "HEC Byte Sta-
tus" indicator into the UDF2 byte position, within each cell that it
routes to the Receive FIFO (and then to the Receive UTOPIA
Interface).
If the user implements this configuration option, then the Receive
ATM Cell Processor block will insert some values into the UDF2
byte-field, that reflect the "HEC Byte Verification" results on this
particular "incoming" ATM cell.
0 - Configures the Receive ATM Cell Processor block to NOT
insert the "HEC Byte Status" value into the UDF2 byte of each
ATM cell that it routes to the Receive FIFO.
1 - Configures the Receive ATM Cell Processor block to insert
the "HEC Byte Status" value into the UDF2 byte of each ATM cell
that it routes to the Receive FIFO.
N
OTE
:
This bit-field is only valid if the Receive UTOPIA Interface
block has been configured to handle 56 byte cells.
5 - 4
HEC Byte Correction
Threshold[1:0]
R/W
HEC Byte Correction Threshold[1:0]:These two READ/WRITE
bit-fields permit the user to define the "HEC Byte Correction"
Threshold for the Receive ATM Cell Processor block. The "HEC
Byte Correction" threshold is defined as the minimum number of
consecutive un-erred (no HEC byte errors) cells that the Receive
ATM Cell Processor must receive before it will transition from the
"Detection Mode" into the "Correction Mode".The relationship
between the value of these bit-fields and the corresponding
"HEC Byte Correction" thresholds is tabulated below.
B
IT
N
UMBER
N
AME
T
YPE
D
ESCRIPTION
HEC Byte Status Value
Corresponding HEC Byte
Verification Results
Error Free HEC Byte Value
Uncorrectable HEC Byte Value
0x00
0xFF
Correctable HEC Byte Value
0xAA
HEC Byte Correction Threshold
1 ATM Cell with a valid HEC Byte
2 consecutive ATM Cells each
with a valid HEC Byte
4 consecutive ATM Cells each
with a valid HEC Byte
8 consecutive ATM cells, each
with a valid HEC byte
HEC Byte Correction
Threshold[1:0]
00
01
10
11
相關(guān)PDF資料
PDF描述
XRT79L72 2 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC
XRT79L72IB 2 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC
XRT79L73 3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC
XRT79L73IB 3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC
XRT79L74 4 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
XRT79L71IB-F 功能描述:時鐘合成器/抖動清除器 RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
XRT79L72 制造商:EXAR 制造商全稱:EXAR 功能描述:2 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC
XRT79L72IB 制造商:EXAR 制造商全稱:EXAR 功能描述:2 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC
XRT79L73 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC
XRT79L73IB 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC
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