T
參數(shù)資料
型號(hào)： XC3SD1800A-4CSG484LI
廠商： Xilinx Inc
文件頁(yè)數(shù)： 20/101頁(yè)
文件大?。?/td> 0K
描述： IC FPGA SPARTAN 3 DSP 484CSGBGA
標(biāo)準(zhǔn)包裝： 84
系列： Spartan®-3A DSP
LAB/CLB數(shù)： 4160
邏輯元件/單元數(shù)： 37440
RAM 位總計(jì)： 1548288
輸入/輸出數(shù)： 309
門(mén)數(shù)： 1800000
電源電壓： 1.14 V ~ 1.26 V
安裝類(lèi)型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 484-FBGA，CSPBGA
供應(yīng)商設(shè)備封裝： 484-CSPBGA
Spartan-3A DSP FPGA Family: DC and Switching Characteristics
DS610 (v3.0) October 4, 2010
Product Specification
25
TIOPLI
The time it takes for data to travel from
the Input pin through the IFF latch to the
I output with no input delay programmed
LVCMOS25(2)
0
XC3SD1800A
1.79
2.04
ns
XC3SD3400A
1.65
2.11
ns
TIOPLID The time it takes for data to travel from
the Input pin through the IFF latch to the
I output with the input delay programmed
LVCMOS25(2)
1
XC3SD1800A
2.23
2.47
ns
2
2.81
3.06
ns
3
3.39
3.86
ns
4
3.89
4.43
ns
5
3.83
4.39
ns
6
4.61
5.32
ns
7
5.40
6.24
ns
8
5.93
6.86
ns
1
XC3SD3400A
2.21
2.67
ns
2
2.71
3.25
ns
3
3.58
4.04
ns
4
4.15
4.62
ns
5
4.03
4.49
ns
6
4.57
5.31
ns
7
5.34
6.18
ns
8
5.84
6.78
ns
Notes:
1.
The numbers in this table are tested using the methodology presented in Table 26 and are based on the operating conditions set forth in
2.
This propagation time requires adjustment whenever a signal standard other than LVCMOS25 is assigned to the data Input. When this is
true, add the appropriate Input adjustment from Table 22.
Table 21: Propagation Times for the IOB Input Path (Cont’d)
Symbol
Description
Conditions
DELAY_VALUE
Device
Speed
Grade
Units
-5
-4
Max
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PDF描述
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XC3SD1800A-4FGG676CES 制造商:Xilinx 功能描述:
XC3SD1800A-4FGG676I 功能描述:SPARTAN-3ADSP FPGA 1800K 676FBGA RoHS:是 類(lèi)別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門(mén)陣列） 系列:Spartan®-3A DSP 標(biāo)準(zhǔn)包裝:40 系列:Spartan® 6 LX LAB/CLB數(shù):3411 邏輯元件/單元數(shù):43661 RAM 位總計(jì):2138112 輸入/輸出數(shù):358 門(mén)數(shù):- 電源電壓:1.14 V ~ 1.26 V 安裝類(lèi)型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:676-BGA 供應(yīng)商設(shè)備封裝:676-FBGA（27x27）
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