T
參數(shù)資料
型號(hào)： XC3SD1800A-4CSG484LI
廠(chǎng)商： Xilinx Inc
文件頁(yè)數(shù)： 18/101頁(yè)
文件大?。?/td> 0K
描述： IC FPGA SPARTAN 3 DSP 484CSGBGA
標(biāo)準(zhǔn)包裝： 84
系列： Spartan®-3A DSP
LAB/CLB數(shù)： 4160
邏輯元件/單元數(shù)： 37440
RAM 位總計(jì)： 1548288
輸入/輸出數(shù)： 309
門(mén)數(shù)： 1800000
電源電壓： 1.14 V ~ 1.26 V
安裝類(lèi)型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 484-FBGA，CSPBGA
供應(yīng)商設(shè)備封裝： 484-CSPBGA
Spartan-3A DSP FPGA Family: DC and Switching Characteristics
DS610 (v3.0) October 4, 2010
Product Specification
23
TIOICKPD
Time from the active transition at the
ICLK input of the Input Flip-Flop (IFF) to
the point where data must be held at the
Input pin. The Input Delay is
programmed.
LVCMOS25(3)
1
XC3SD1800A
–1.40 –1.40
ns
2
–2.11 –2.11
ns
3
–2.48 –2.48
ns
4
–2.77 –2.77
ns
5
–2.62 –2.62
ns
6
–3.06 –3.06
ns
7
–3.42 –3.42
ns
8
–3.65 –3.65
ns
1
XC3SD3400A
–1.31 –1.31
ns
2
–1.88 –1.88
ns
3
–2.44 –2.44
ns
4
–2.89 –2.89
ns
5
–2.83 –2.83
ns
6
–3.33 –3.33
ns
7
–3.63 –3.63
ns
8
–3.96 –3.96
ns
Set/Reset Pulse Width
TRPW_IOB Minimum pulse width to SR control input
on IOB
–
All
1.33
1.61
ns
Notes:
1.
The numbers in this table are tested using the methodology presented in Table 26 and are based on the operating conditions set forth in
2.
This setup time requires adjustment whenever a signal standard other than LVCMOS25 is assigned to the data Input. If this is true, add the
appropriate Input adjustment from Table 22.
3.
These hold times require adjustment whenever a signal standard other than LVCMOS25 is assigned to the data Input. If this is true, subtract
the appropriate Input adjustment from Table 22. When the hold time is negative, it is possible to change the data before the clock’s active
edge.
Table 20: Sample Window (Source Synchronous)
Symbol
Description
Max
Units
TSAMP
Setup and hold
capture window of
an IOB flip-flop.
The input capture sample window value is highly specific to a particular application, device,
package, I/O standard, I/O placement, DCM usage, and clock buffer. Please consult the
appropriate Xilinx Answer Record for application-specific values.
Answer Record 30879
ps
Table 19: Setup and Hold Times for the IOB Input Path (Cont’d)
Symbol
Description
Conditions
DELAY_
VALUE
Device
Speed
Units
-5
-4
Min
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PDF描述
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XC3SD1800A-4FGG676I 功能描述:SPARTAN-3ADSP FPGA 1800K 676FBGA RoHS:是 類(lèi)別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門(mén)陣列） 系列:Spartan®-3A DSP 標(biāo)準(zhǔn)包裝:40 系列:Spartan® 6 LX LAB/CLB數(shù):3411 邏輯元件/單元數(shù):43661 RAM 位總計(jì):2138112 輸入/輸出數(shù):358 門(mén)數(shù):- 電源電壓:1.14 V ~ 1.26 V 安裝類(lèi)型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:676-BGA 供應(yīng)商設(shè)備封裝:676-FBGA（27x27）
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