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參數(shù)資料
| 型號(hào)： | W986432EH-7 |
| 廠商： | WINBOND ELECTRONICS CORP |
| 元件分類(lèi)： | DRAM |
| 英文描述： | 2M X 32 SYNCHRONOUS DRAM, 5.5 ns, PDSO86 |
| 封裝： | 0.400 INCH, TSOP2-86 |
| 文件頁(yè)數(shù)： | 38/48頁(yè) |
| 文件大?。?/td> | 1180K |
| 代理商： | W986432EH-7 |
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W986432EH / W9864G2EH
Publication Release Date: August 17 ,2005
- 43 -
Revision A09
15.20 Timing Chart of Burst Stop Cycle (Precharge Command)
01
11
10
9
8
7
6
5
4
3
2
(1) Read cycle
(a) CAS latency =2
Command
Q0
Q1
Q2
Q3
Q4
PRCG
Read
(b) CAS latency =3
Command
Q0
Q1
Q2
Q3
Q4
PRCG
Read
DQ
(2) Write cycle
(a) CAS latency =2
Command
Q0
Q1
Q2
Q3
Q4
PRCG
Write
(b) CAS latency =3
Command
Q0
Q1
Q2
Q3
Q4
Write
DQ
DQM
PRCG
tWR
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