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參數(shù)資料
| 型號： | W83627UHG |
| 廠商： | Nuvoton Technology Corporation of America |
| 文件頁數(shù)： | 61/240頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC I/O CONTROLLER 128-QFP |
| 標準包裝： | 66 |
| 應(yīng)用： | PC，PDA |
| 接口： | LPC |
| 電源電壓： | 3.3V，5V |
| 封裝/外殼： | 128-XFQFN |
| 供應(yīng)商設(shè)備封裝： | 128-QFP（14x20） |
| 包裝： | 管件 |
| 安裝類型： | 表面貼裝 |
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W83627UHG
Publication Release Date: March 24, 2008
-138-
Revision 1.44
ENMDAT_UP
(LOGICAL DEVICE A,
CR[E6H], BIT 7)
MSRKEY
(LOGICAL DEVICE
A, CR[E0H], BIT 4)
MSXKEY
(LOGICAL
DEVICE A,
CR[E0H], BIT 1)
WAKE-UP EVENT
1
x
0
One click of the left or right
button.
0
1
One click of the left button.
0
1
One click of the right button.
0
Two clicks of the left button.
0
1
0
Two clicks of the right button.
13.3 Resume Reset Logic
The RSMRST# (Pin 75) signal is a reset output and is used as the 5VSB power on reset signal for the
South Bridge.
When the W83627UHG detects the 5VSB voltage rises to “V1”, it then starts a delay – “t1” before the
rising edge of RSMRST# asserting. If the 5VSB voltage falls below “V2”, the RSMRST# de-asserts
immediately.
Timing and voltage parameters are shown in Figure 13-3 and Table 13-3.
t1
V1
RSMRST#
5VSB
V2
Figure 13-3 Mechanism of Resume Reset Logic
Table 13-3 Timing and Voltage Parameters of RSMRST#
NAME
PARAMETER
MIN.
MAX.
UNIT
V1
5VSB Valid Voltage
-
4.3
V
V2
5VSB Ineffective Voltage
2.6
-
V
t1
Valid 5VSB to RSMRST# inactive
100
200
mS
13.4 PWROK Generation
The PWROK (Pin 71) signal is an output and is used as both the 5VCC and 3VCC power-on reset
signal.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| X90100M8IZT1 | IC DIGITAL CAPACITOR NV 8-MSOP |
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參數(shù)描述 |
|---|---|
| W83628AG | 制造商:Nuvoton Technology Corp 功能描述:PCI to ISA Bus Conversion 128-Pin QFP 制造商:Nuvoton Technology 功能描述:PCI to ISA Bus Conversion 128-Pin QFP |
| W83628F | 制造商:WINBOND 制造商全稱:Winbond 功能描述:PCI TO ISA BRIDGE SET |
| W83629AG | 制造商:Nuvoton Technology Corp 功能描述:PCI to ISA Bus Conversion 48-Pin LQFP |
| W83629D | 制造商:WINBOND 制造商全稱:Winbond 功能描述:PCI TO ISA BRIDGE SET |
| W83637HF | 制造商:WINBOND 制造商全稱:Winbond 功能描述:LPC I/O |
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