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參數(shù)資料
| 型號(hào)： | W83627UHG |
| 廠商： | Nuvoton Technology Corporation of America |
| 文件頁(yè)數(shù)： | 53/240頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC I/O CONTROLLER 128-QFP |
| 標(biāo)準(zhǔn)包裝： | 66 |
| 應(yīng)用： | PC，PDA |
| 接口： | LPC |
| 電源電壓： | 3.3V，5V |
| 封裝/外殼： | 128-XFQFN |
| 供應(yīng)商設(shè)備封裝： | 128-QFP（14x20） |
| 包裝： | 管件 |
| 安裝類型： | 表面貼裝 |
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W83627UHG
Publication Release Date: March 24, 2008
-131-
Revision 1.44
12.5 Hardware GATEA20/Keyboard Reset Control Logic
The KBC includes hardware control logic to speed-up GATEA20 and KBRESET. This control logic is
controlled by LD5-CRF0 as follows:
12.5.1
KB Control Register (Logic Device 5, CR-F0)
BIT
7
6
5
4
3
2
1
0
NAME
KCLKS1
KCLKS0
RESERVED
P92EN
HGA20
HKBRST#
DEFAULT
1
0
BIT
DESCRIPTION
7
KCLKS1
.
6
KCLKS0
.
Select the KBC clock rate.
Bits
7 6
0 0: KBC clock input is 6 MHz.
0 1: KBC clock input is 8 MHz.
1 0: KBC clock input is 12 MHz.
1 1: KBC clock input is 16 MHz.
5-3
RESERVED
.
2
P92EN
(Port 92 Enable).
1: Enables Port 92 to control GATEA20 and KBRESET.
0: Disables Port 92 functions.
1
HGA20
(Hardware GATEA 20).
1: Selects hardware GATE A20 control logic to control GATE A20 signal.
0: Disables GATEA20 control logic functions.
0
HKBRST#
(Hardware Keyboard Reset).
1: Selects hardware KB RESET control logic to control KBRESET signal.
0: Disables hardware KB RESET control logic function.
When the KBC receives data that follows a "D1" command, the hardware control logic sets or clears
GATE A20 according to received data bit 1. Similarly, the hardware control logic sets or clears
KBRESET depending on received data bit 0. When the KBC receives an "FE" command, the
KBRESET is pulse low for 6
μs (Min.) with a 14 μs (Min.) delay.
GATE A20 and KBRESET are controlled by either software or hardware logic, and they are mutually
exclusive. Then, GATE A20 and KBRESET are merged with Port92 when the P92EN bit is set.
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