- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄1971 > UPD78F1235GK-GAJ-AX (Renesas Electronics America)MCU 16BIT 78K0R/LX3 64-LQFP PDF資料下載
參數(shù)資料
| 型號： | UPD78F1235GK-GAJ-AX |
| 廠商： | Renesas Electronics America |
| 文件頁數(shù)： | 986/1067頁 |
| 文件大?。?/td> | 0K |
| 描述： | MCU 16BIT 78K0R/LX3 64-LQFP |
| 標準包裝： | 300 |
| 系列： | 78K0R/Ix3 |
| 核心處理器： | 78K/0R |
| 芯體尺寸： | 16-位 |
| 速度： | 40MHz |
| 連通性： | 3 線 SIO，I²C，LIN，UART/USART |
| 外圍設(shè)備： | DMA，LVD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 50 |
| 程序存儲器容量： | 64KB（64K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 3K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 12x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 64-LQFP |
| 包裝： | 托盤 |
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CHAPTER 20 POWER-ON-CLEAR CIRCUIT
User’s Manual U19678EJ1V1UD
923
20.2 Configuration of Power-on-Clear Circuit
The block diagram of the power-on-clear circuit is shown in Figure 20-1.
Figure 20-1. Block Diagram of Power-on-Clear Circuit
+
Reference
voltage
source
Internal reset signal
VDD
20.3 Operation of Power-on-Clear Circuit
An internal reset signal is generated on power application. When the supply voltage (VDD) exceeds the
detection voltage (VPDR = 1.61 V
±0.09 V), the reset status is released.
The supply voltage (VDD) and detection voltage (VPDR = 1.59 V ±0.09 V) are compared. When VDD < VPDR, the
internal reset signal is generated.
The timing of generation of the internal reset signal by the power-on-clear circuit and low-voltage detector is shown
below.
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