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參數(shù)資料
| 型號(hào)： | UPD75236 |
| 廠商： | NEC Corp. |
| 英文描述： | 4-BIT SINGLE-CHIP MICROCOMPUTER |
| 中文描述： | 4位單片機(jī) |
| 文件頁(yè)數(shù)： | 143/190頁(yè) |
| 文件大小： | 1220K |
| 代理商： | UPD75236 |
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μ
PD75236
The STOP and HALT modes are set by STOP and HALT instructions, respectively. (The two instructions are
instructions to set PCC bit 3 and bit 2, respectively.)
When changing the CPU operation clock with the least significant 2 bits of PCC, a delay may result from
PCC rewrite to CPU clock change as shown in Table 4-1. Thus, when changing the operation clock before the
standby mode is set or the CPU clock after the standby mode is released, set the standby mode after the
passage of the machine cycle required for CPU clock change following PCC rewrite.
In the standby mode, the data of all registers and data memories which stop operating is held. Such units
include general registers, flag, mode registers and output latches.
Note 1.
When the STOP mode is set, X1 input is internally short-circuited to V
SS
(GND potential) to prevent
leakage from the crystal resonator unit. Thus, the use of STOP mode is prohibited in a system
using external clocks.
Because the interrupt request signal is used to release the standby mode, the standby mode is
immediately released if there is an interrupt source with both the interrupt request flag and inter-
rupt enable flag set. Thus, the STOP mode is set to the HALT mode just after STOP instruction
execution. After waiting for the time period set by the BTM register, the operating mode is reset.
2.
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