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參數資料
| 型號： | UPD70F3017AYF1-EA6-A |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, FLASH, 20 MHz, MICROCONTROLLER, PBGA121 |
| 封裝： | 12 X 12 MM, LEAD FREE, PLASTIC, FBGA-121 |
| 文件頁數： | 17/492頁 |
| 文件大小： | 3420K |
| 代理商： | UPD70F3017AYF1-EA6-A |
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CHAPTER 5 INTERRUPT/EXCEPTION PROCESSING FUNCTION
User’s Manual U12768EJ4V1UD
113
5.2.3
NP flag
The NP flag is a status flag that indicates that non-maskable interrupt (NMI) servicing is under execution. This flag
is set when an NMI interrupt request has been acknowledged, and masks all interrupt requests to prohibit multiple
interrupts from being acknowledged.
Figure 5-4. NP Flag (NP)
After reset: 00000020H
Symbol
31
8
7
6
5
4
3
2
1
0
PSW
0
NP EP
ID SAT CY OV
S
Z
NP
NMI Servicing State
0
No NMI interrupt servicing
1
NMI interrupt currently being serviced
5.2.4
Noise elimination of external interrupt request input pin
(1) Noise elimination of NMI and INTP0 to INTP3 pins
The noise of the NMI pin and INTP0 to INTP3 pins is eliminated by the noise eliminator using analog delay.
Therefore, signals input to the NMI and INTP0 to INTP3 pins are not detected as an edge, unless they maintain
their input level for a certain period. The edge is detected after a certain period has elapsed.
The NMI and INTP0 to INTP3 pins can be used for releasing the software STOP mode. In the software STOP
mode, the system clock is not used for noise elimination because the internal system clock is stopped.
(2) Noise elimination of INTP4 to INTP6 pins
The INTP4 to INTP6 pins incorporate a digital noise eliminator. If the input level of the INTP pin is detected by
the sampling clock (fXX) and the same level is not detected three successive times, the input pulse is eliminated
as a noise. In the software STOP mode, the INTP4 to INTP6 pins cannot be used for releasing the software
STOP mode because the internal system clock is stopped. Note the following.
If the input pulse width is between 2 and 3 clocks, whether the input pulse is detected as a valid edge or
eliminated as noise is undefined. To securely detect the level as a valid edge, the same level input of 3 clocks
or more is required.
When noise is generated in synchronization with the sampling clock, this may not be recognized as noise. In
this case, eliminate the noise by adding a filter to the input pin.
相關PDF資料 |
PDF描述 |
|---|---|
| UPD70F3015BGC-8EU-A | 32-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQFP100 |
| UPD70F3038F1-EN2 | 32-BIT, FLASH, 20 MHz, MICROCONTROLLER, PBGA180 |
| UPD70F3040F1-EN2 | 32-BIT, FLASH, 20 MHz, MICROCONTROLLER, PBGA180 |
| UPD70F3040YGU-UEU-A | 32-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQFP176 |
| UPD70F3040YGU-UEU-A | 32-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQFP176 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| UPD70F3017AYGC-8EU | 制造商:NEC 制造商全稱:NEC 功能描述:32-BIT SINGLE-CHIP MICROCONTROLLER |
| uPD70F3017AYGC-8EU(A) | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD70F3017AYGC-8EU-A | 制造商:Renesas Electronics Corporation 功能描述: 制造商:Renesas Electronics Corporation 功能描述:MCU 32-Bit V850 RISC 256KB Flash 3.3V 100-Pin LQFP |
| UPD70F3018GC-7EA-V8 | 制造商:NEC Electronics Corporation 功能描述: |
| UPD70F3025A | 制造商:NEC 制造商全稱:NEC 功能描述:V853TM 32-/16-BIT SINGLE-CHIP MICROCONTROLLER |
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