參數資料
型號： TL16C552AHV
廠商： Texas Instruments, Inc.
英文描述： DUAL ASYNCHRONOUS COMMUNICATIONS ELEMENT WITH FIFO
中文描述： 雙異步通信元帶有FIFO
文件頁數： 15/39頁
文件大?。?/td> 545K
代理商： TL16C552AHV
TL16C552A, TL16C552AM
DUAL ASYNCHRONOUS COMMUNICATIONS ELEMENT
WITH FIFO
SLLS189D – NOVEMBER 1994 – REVISED JANUARY 1999
15
POST OFFICE BOX 655303
DALLAS, TEXAS 75265
PARAMETER MEASUREMENT INFORMATION
Active
IOR
(RD RBR)
CLK
Sample
SIN
(first byte)
Stop
td9
(see Note B )
RXRDY
tpd8
(see Note A)
50%
50%
50%
NOTES: A. This is the reading of the last byte in the FIFO.
B. If FCR0 = 1, td9 = 3 RCLK cycles. For a time-out interrupt, td9 = 8 RCLK cycles.
Figure 12. Receiver Ready Mode 0 Waveforms
Active
IOR
(RD RBR)
CLK
Sample
Stop
td9
(see Note B)
RXRDY
tpd8
SIN
(first byte that reaches
the trigger level)
(see Note A)
50%
50%
50%
NOTES: A. This is the reading of the last byte in the FIFO.
B. If FCR0–1, td9 = 3 RCLK cycles. For a trigger change level interrupt, td9 = 8 RCLK.
Figure 13. Receiver Ready Mode 1 Waveforms
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PDF描述
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參數描述
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