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參數(shù)資料
| 型號(hào)： | SYM53C895 |
| 廠商： | LSI Corporation |
| 英文描述： | PCI to Ultra2 SCSI I/O Processor with LVD（Low Voltage Differential Link）Universal Transceivers(PCI與Ultra2 SCSI I/O接口處理器（帶低電壓差分連接通用收發(fā)器）) |
| 中文描述： | PCI到Ultra2的SCSI I / O處理器與LVD（低電壓差分鏈接）通用收發(fā)器（的PCI與Ultra2的SCSI的I / O接口處理器（帶低電壓差分連接通用收發(fā)器）） |
| 文件頁(yè)數(shù)： | 95/326頁(yè) |
| 文件大?。?/td> | 2938K |
| 代理商： | SYM53C895 |
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Draft xx/xx/xx
Pin Descriptions
Rev. letter
4-17
Copyright 1999 by LSI Logic Corporation. All rights reserved.
IRQ/
59
U20
O
Interrupt. This signal, when asserted low, indicates that an
interrupting condition has occurred and that service is
required from the host CPU. The output drive of this pin is
programmed as either open drain with an internal weak pull-
up or, optionally, as a totem pole driver. Refer to the
description of the DCNTL Register, bit 3, for additional
information.
BIG_LIT/
192
P3
I
Big_Little endian select. When this pin is driven low, the
SYM53C895 routes the first byte of an aligned SCSI to PCI
transfer to byte lane zero of the PCI bus and subsequent
bytes received are routed to ascending lanes. An aligned PCI
to SCSI transfer routes PCI byte lane zero onto the SCSI bus
first, and transfer ascending byte lanes in order. When this pin
is driven high, the SYM53C895 routes the first byte of an
aligned SCSI to PCI transfer to byte lane three of the PCI bus
and subsequent bytes received are routed to descending
lanes. An aligned PCI to SCSI transfer routes PCI byte lane
three onto the SCSI bus first and transfer descending byte
lanes in order. This mode of operation also applies to the
external memory interface. When this pin is driven in Little
Endian mode and the chip is performing a read from external
memory, the byte of data accessed at location 0x00000 is
routed to PCI byte lane zero and the data accessed at location
0x00003 is routed to PCI byte lane three. When the chip is
performing a write to flash memory, PCI byte lane zero is
routed to location 0x00000 and ascending byte lanes are
routed to subsequent memory locations. When this pin is
driven in Big Endian mode and the chip is performing a read
from external memory, the byte of data accessed at location
0x00000 is routed to PCI byte lane three and the data
accessed at location 0x00003 is routed to byte lane zero.
When the chip is performing a write to flash memory, PCI byte
lane three is routed to location 0x00000 and descending byte
lanes are routed to subsequent memory locations.
Test Pins
82, 177, 180,
181, 182, 183
J1, J19, K1,
L1, L2, L3
I/O
LSI Logic uses Test Pins for diagnostic testing. These pins
should not be used in actual system design; they must be left
floating or pulled high.
Table 4.11
Additional Pins (Cont.)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SYM53C896 | PCI to Dual Channel Ultra2 SCSI Multifunction Controller(PCI與雙通道Ultra2 SCSI連接多功能控制器) |
| SYMFC909 | Fibre Channel Protocol Controller(光纖通道協(xié)議控制器) |
| T-13811 | T1/CEPT Telecom Applications |
| T-17009 | Meets all IEE 802.3 and ANSI X3.263 standards including 350 mH OCL with 8 mA bias |
| T-17204 | 10/100 BASE-T SINGLE PORT SURFACE MOUNT MAGNETICS |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SYM53C896 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:BUS CONTROLLER |
| SYM-63LH+ | 制造商:MINI 制造商全稱:Mini-Circuits 功能描述:Frequency Mixer |
| SYM8291 | 制造商: 功能描述: 制造商:undefined 功能描述: |
| SYM-A-100 | 制造商:Sliger Designs, Inc. 功能描述:SPEAKER HARNESS - Bulk 制造商:Sliger Designs, Inc. 功能描述:SCANNER FRAMES DESIGNED TO FIT DIFFERENT STORE COUNTER TOPS - Bulk |
| SYM-A-200 | 制造商:Sliger Designs, Inc. 功能描述:SCANNER FRAMES DESIGNED TO FIT DIFFERENT STORE COUNTER TOPS - Bulk |
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