參數(shù)資料
型號(hào)： SYM53C895
廠商： LSI Corporation
英文描述： PCI to Ultra2 SCSI I/O Processor with LVD（Low Voltage Differential Link）Universal Transceivers(PCI與Ultra2 SCSI I/O接口處理器（帶低電壓差分連接通用收發(fā)器）)
中文描述： PCI到Ultra2的SCSI I / O處理器與LVD（低電壓差分鏈接）通用收發(fā)器（的PCI與Ultra2的SCSI的I / O接口處理器（帶低電壓差分連接通用收發(fā)器））
文件頁(yè)數(shù)： 288/326頁(yè)
文件大?。?/td> 2938K
代理商： SYM53C895
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7-62
Electrical Characteristics
Table 7.52
BGA #
BGA Position Numerically and Signal Name
Signal
BGA #
Signal
V9
V10
V11
V12
V13
V14
V15
V16
V17
V18
V19
V20
W1
W2
W3
W4
W5
W6
W7
W8
W9
W10
W11
W12
W13
W14
W15
W16
W17
W18
W19
W20
Y1
Y2
Y3
Y4
Y5
Y6
Y7
Y8
Y9
Y10
Y11
Y12
Y13
Y14
Y15
Y16
Y17
Y18
Y19
Y20
FRAME/
N/C
PERR/
AD15
AD12
N/C
N/C
N/C
AD4
AD2
N/C
AD0
AD28
N/C
N/C
N/C
AD24
AD23
AD20
AD17
IRDY/
TRDY/
STOP/
C_BE1/
AD13
AD10
AD8
N/C
AD6
V5BIAS(PCI)
N/C
N/C
N/C
N/C
AD26
V5BIAS(PCI)
C_BE3/
AD22
AD19
AD16
N/C
DEVSEL/
N/C
PAR
AD14
AD11
AD9
C_BE0/
AD7
AD5
AD3
N/C
BGA #
Signal
A1
A2
A3
A4
A5
A6
A7
A8
A9
A10
A11
A12
A13
A14
A15
A16
A17
A18
A19
A20
B1
B2
B3
B4
B5
B6
B7
B8
B9
B10
B11
B12
B13
B14
B15
B16
B17
B18
B19
B20
C1
C2
C3
C4
C5
C6
C7
C8
C9
C10
C11
C12
C13
C14
C15
C16
C17
C18
C19
C20
VSS
N/C
SD2+
SD3+
SD4+
N/C
SD5
SD6
SD7
RBIAS
VDD_RBIAS
SATN+
SBSY+
SACK+
SRST+
SMSG+
SSEL+
SSEL
N/C
N/C
N/C
SD1+
SD1
SD2
SD3
SD4
SD5+
SD6+
SD7+
SDP0
N/C
SATN
SBSY
SACK
SRST
SMSG
N/C
N/C
N/C
N/C
SD0
N/C
N/C
N/C
N/C
N/C
N/C
N/C
N/C
SDP0+
N/C
N/C
N/C
N/C
N/C
N/C
SCD
N/C
SREQ+
SIO
D1
D2
D3
D4
D5
D6
D7
D8
D9
D10
D11
D12
D13
D14
D15
D16
D17
D18
D19
D20
E1
E2
E3
E4
E17
E18
E19
E20
F1
F2
F3
F4
F17
F18
F19
F20
G1
G2
G3
G4
G17
G18
G19
G20
H1
H2
H3
H4
H8
H9
H10
H11
H12
H13
H17
H18
H19
H20
J1 LVDSMDIFFSENS
J2
SD0+
N/C
N/C
VSS
N/C
VDD
N/C
VSS
N/C
N/C
VDD
N/C
VSS
N/C
VDD
SCD+
VSS
SREQ
SD8+
SD8
SDP1
N/C
N/C
N/C
SIO+
N/C
SD9+
SD9
SD15+
SD15
SDP1+
VDD
VDD
N/C
SD10+
SD10
SD14+
SD14
N/C
N/C
N/C
N/C
SD11+
SD11
SD13+
SD13
N/C
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
N/C
VDDA
SD12+
J3
J4
J8
J9
J10
J11
J12
J13
J17
J18
J19
J20
K1
K2
K3
K4
K8
K9
K10
K11
K12
K13
K17
K18
K19
K20
L1
L2
L3
L4
L8
L9
L10
L11
L12
L13
L17
L18
L19
L20
M1
M2
M3
M4
M8
M9
M10
M11
M12
M13
M17
M18
M19
M20
N1
N2
N3
N4
N8
N9
SD12
N/C
VSS
VSS
VSS
VSS
VSS
VSS
N/C
VSSA
TEST_HSC/
SCLK
TEST
TESTIN
N/C
VDD
VSS
VSS
VSS
VSS
VSS
VSS
N/C
N/C
MAC/_TESTOUT
MAD0
TEST
TEST
TEST
N/C
VSS
VSS
VSS
VSS
VSS
VSS
VDD
N/C
MAD2
MAD1
MAS1/
MAS0/
VSSCORE
N/C
VSS
VSS
VSS
VSS
VSS
VSS
N/C
MAD5
MAD4
MAD3
VSSCORE2
MWE/
MOE/
VSS
VSS
VSS
N10
N11
N12
N13
N17
N18
N19
N20
P1
P2
P3
P4
P17
P18
P19
P20
R1
R2
R3
R4
R17
R18 GPIO1_MASVDD
R19
R20
T1
T2
T3
T4
T17
T18
T19
GPIO0_FETN/C
T20
V5BIAS(MEM)
U1
U2
U3
U4
U5
U6
U7
U8
U9
U10
U11
U12
U13
U14
U15
U16
U17
U18
U19
U20
V1
V2
V3
V4
V5
V6
V7
V8
VSS
VSS
VSS
VSS
VSS
VSSCORE
MAD7
MAD6
VDDCORE
VDDCORE
BIG_LIT/
N/C
VDDCORE
GPIO3
GPIO4
VSSCORE
MCE/
RST/
N/C
VDD
VDDCORE
GPIO2
CLK
GNT/
N/C
N/C
N/C
REQ/
AD31
N/C
VSS
N/C
VDD
N/C
VSS
C_BE2/
VDD
SERR/’
N/C
VSS
N/C
VDD
N/C
VSS
AD1
N/C
IRQ/
AD30
AD29
AD27
N/C
AD25
IDSEL
AD21
AD18
BGA #
Signal
BGA #
Signal
1. NC pins are not connected.
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