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參數(shù)資料
| 型號： | SYM53C710 |
| 廠商： | LSI Corporation |
| 英文描述： | 32-Bit SCSI I/O Processor(32位SCSI I/O處理器) |
| 中文描述： | 32位SCSI I / O處理器（32位的SCSI的I / O處理器） |
| 文件頁數(shù)： | 91/248頁 |
| 文件大小： | 3027K |
| 代理商： | SYM53C710 |
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Register Descriptions
4-31
hardware on those host buses on which data and
addresses share a common 32 bits.
ZMOD
High Impedance Mode
Setting this bit causes the SYM53C710 to place all output
and bidirectional pins into a high impedance state. In
order to read data out of the SYM53C710, this bit must
be cleared.
6
This bit is intended for board level testing only. Setting
this bit during system operation results in a system
failure.
SZM
SCSI High Impedance Mode
Setting this bit causes the SYM53C710 to place certain
SCSI outputs in a high impedance state. The following
outputs are in a high impedance state: SD[7:0], SDP,
BYS/, SEL/, RST/, REQ/, C/D, I/O, MSG/, ACK/, ATN/.
The direction control lines (SDIR[7:0], SDIRP, BSYDIR,
RSTDIR, and SELDIR) are driven LOW and are not in a
high impedance state. In order to transfer data on the
SCSI bus, this bit must be cleared.
5
SLBE
SCSI Loopback Enable
Setting this bit enables loopback mode. Loopback allows
any SCSI signal to be asserted. SYM53C710 may be an
initiator or a target. It also allows the SYM53C710 to
transfer data from the
SCSI Output Data Latch (SODL)
register back into the
SCSI Input Data Latch (SIDL)
register.
4
SFWR
SCSI FIFO Write Enable
Setting this bit redirects data from the SODL to the SCSI
FIFO. A write to the
SCSI Output Data Latch (SODL)
register loads a byte into the SCSI FIFO. The parity bit
loaded into the FIFO is odd or even parity depending on
the status of the Assert SCSI Even Parity bit in the
SCSI
Control One (SCNTL1)
register. Clearing this bit will
disable this feature.
3
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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