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參數(shù)資料
| 型號： | ST72T85A5Q6 |
| 廠商： | 意法半導體 |
| 英文描述： | 8-BIT MCU FOR RDS WITH 48K ROM, 3K RAM, ADC, TWO TIMERS, TWO SPIs, I2C AND SCI INTERFACES |
| 中文描述： | 8位微控制器48,000鐵路發(fā)展策略光盤，3K內存，ADC，兩個定時器，2個SPI，I2C和脊髓損傷接口 |
| 文件頁數(shù)： | 57/117頁 |
| 文件大?。?/td> | 748K |
| 代理商： | ST72T85A5Q6 |
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57/117
ST7285C
I
2
C BUS INTERFACE
(Cont’d)
4.5.5 Register Description
CLOCK CONTROL REGISTER (CCR)
Address: 002Bh
—
Reset Value: 00h
Read / Write
b7:
FM/SM
Fast / Standard I
2
C mode
When the bit is set to 1 the interface operates in
the fast I
2
C bus mode.
When the bit is set to 0 the interface operates in
the standard I
2
C bus mode.
b6-0:
D6-D0
7 bit divider programming
Implementation of a programmable clock divider
In Standard I
2
C mode:
Fscl = PHI1/(2x([D6..D0]+2)); in this case, Fscl
varies
between
15.75KHz and 100
PHI1=4MHz).
In Fast I
2
C mode:
Fscl = PHI1/(3x([D6..D0]+2)); in this case, Fscl
varies
between
10.5
PHI1=4MHz).
KHz (if
KHz
and
333KHz
(if
Table 8. Example of SCL frequency with PHI1 = 4 MHz in Standard I
2
C mode
7
0
FM/SM
CC6
CC5
CC4
CC3
CC2
CC1
CC0
FM/SM
0
0
0
0
0
1
1
1
1
1
1
D6
0
0
0
1
1
0
0
0
0
0
1
D5
0
0
1
0
1
0
0
0
0
0
1
D4
1
1
0
0
1
0
0
0
0
1
1
D3
0
1
0
1
1
0
0
0
1
1
1
D2
0
0
1
1
1
0
1
1
1
0
1
D1
1
1
1
1
1
1
0
1
0
1
1
D0
0
1
0
0
1
0
1
0
1
1
1
Fscl(Khz)
100
70
50
25
15.75
333
190
167
89
43
10.5
相關PDF資料 |
PDF描述 |
|---|---|
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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