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參數(shù)資料
| 型號(hào)： | ST72F652R4T1 |
| 廠商： | STMICROELECTRONICS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP64 |
| 封裝： | 14 X 14 MM, TQFP-64 |
| 文件頁數(shù)： | 103/160頁 |
| 文件大?。?/td> | 974K |
| 代理商： | ST72F652R4T1 |
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ST7265
47/160
POWER SAVING MODES (Cont’d)
8.3 HALT MODE
The HALT mode is the MCU lowest power con-
sumption mode. The HALT mode is entered by ex-
ecuting the HALT instruction. The internal oscilla-
tor is then turned off, causing all internal process-
ing to be stopped, including the operation of the
on-chip peripherals.
When entering HALT mode, the I1:0] bits in the
Condition Code Register are cleared. Thus, any of
the external interrupts (ITi or USB end suspend
mode), are allowed and if an interrupt occurs, the
CPU clock becomes active.
The MCU can exit HALT mode on reception of ei-
ther an external interrupt on ITi, an end suspend
mode interrupt coming from USB peripheral, or a
reset. The oscillator is then turned on and a stabi-
lization time is provided before releasing CPU op-
eration. The stabilization time is 512 CPU clock cy-
cles.
After the start up delay, the CPU continues opera-
tion by servicing the interrupt which wakes it up or
by fetching the reset vector if a reset wakes it up.
Figure 32. HALT Mode Flow Chart
N
EXTERNAL
INTERRUPT*
RESET
HALT INSTRUCTION
FETCH RESET VECTOR
OR SERVICE INTERRUPT
DELAY
CPU CLOCK
OSCILLATOR
PERIPH. CLOCK
I1:0] BITS
ON
SET
ON
CPU CLOCK
OSCILLATOR
PERIPH. CLOCK
I1:0] BITS
OFF
CLEARED
OFF
Y
Note: Before servicing an interrupt, the CC
register is pushed on the stack. TheI1:0] bits are
set during the interrupt routine and cleared
when the CC register is popped.
(Refer to Figure 18 and
Figure 19)
1
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