參數(shù)資料
型號(hào)： ST10F296TR
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： 16-BIT, FLASH, 64 MHz, MICROCONTROLLER, PBGA208
封裝： 23 X 23 MM, 1.96 MM HEIGHT, 1.27 MM PITCH, ROHS COMPLIANT, PLASTIC, BGA-208
文件頁(yè)數(shù)： 110/346頁(yè)
文件大?。?/td> 5607K
代理商： ST10F296TR
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CAN modules
ST10F296E
198/346
Considering the PLL effect, Equation 17 and Equation 18 below are modified for the two
CAN conditions to give the phase error:
Equation 17
Equation 18
Where
δPLL represents the absolute deviation introduced by the PLL jitter.
In Equation 17 and Equation 18 the value of
δPLL must be evaluated for different numbers of
clock periods. For the first clock period, the jitter corresponding to 10 bit time periods must
be considered, while for the second clock period, the jitter corresponding to 13 bit time
periods must be considered. The number of clock periods must be computed taking account
of the baud rate prescaler setting. A factor of two, which multiplies the single CAN node
phase deviation, is considered to take account of the worst case scenario where two
communicating nodes are at the opposite limits of the specified frequency tolerance.
From Equation 17 and Equation 18, the new constraints for the CAN system clock tolerance
can be translated into new quality requirements for the oscillator as shown in Equation 19
Equation 19
Equation 20
It is obvious that the PLL jitter imposes more stringent constraints on oscillator tolerance
than what can be accepted when no PLL is used. The ST10F296E PLL characteristics are
such that the oscillator requirements are acceptably impacted by the jitter for the majority of
the worst CAN bus network configurations.
Oscillator tolerance range was increased when the CAN protocol was developed from
version 1.1 to version 1.2 (version 1.0 was never implemented in silicon). The option to
synchronize on edges from dominant to recessive became obsolete and only edges from
recessive to dominant are now considered for synchronization. Protocol update to version
2.0 (A and B) has had no influence on oscillator tolerance.
It must be considered that SJW may not be larger than the smaller of the phase buffer
segments and that the propagation time segment limits the part of the bit time that may be
used for the phase buffer segments.
The combination below allows the largest possible frequency tolerance of 1.58 % (in the
absence of PLL jitter):
●
Prop_Seg = 1
●
Phase_Seg1 = Phase_Seg2 = SJW = 4
This combination with a propagation time segment of only 10 % of the bit time is not suitable
for short bit times. It can be used for bit rates of up to 125 Kbit/s (bit time = 8 s) with a bus
length of 40 m.
t
J
2df
10
t
BT
δ
PLL
+
×
()
×
=
t
S
2df13
t
BT
×
t
PB2
–
() δ
PLL
+
×
[]
×
=
df
t
SJW
2
δ
PLL
×
210t
BT
×
–
<
df
min t
PB1
t
PB2
,
() 2 δ
PLL
×
213
t
BT
×
t
PB2
–
()
×
–
<
相關(guān)PDF資料
PDF描述
ST10R172LT6 16-BIT, 50 MHz, MICROCONTROLLER, PQFP100
ST10R272LT6 16-BIT, 50 MHz, MICROCONTROLLER, PQFP100
ST16C452PSIJ68 2 CHANNEL(S), SERIAL COMM CONTROLLER, PQCC68
ST16C452ATIJ68 2 CHANNEL(S), SERIAL COMM CONTROLLER, PQCC68
ST16C654IQ64/TR 4 CHANNEL(S), 1.5M bps, SERIAL COMM CONTROLLER, PQFP64
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
ST10-IP-EE 功能描述:電機(jī)驅(qū)動(dòng)器 RoHS:否 制造商:Applied Motion 電機(jī)驅(qū)動(dòng)類型:2035 Step 電源電壓:12 V to 35 V 功率額定值:70 W 每轉(zhuǎn)步距分辨率:200 to 400 框架大小 (NEMA):
ST10-IP-EE (5000-182) 功能描述:電機(jī)驅(qū)動(dòng)器 RoHS:否 制造商:Applied Motion 電機(jī)驅(qū)動(dòng)類型:2035 Step 電源電壓:12 V to 35 V 功率額定值:70 W 每轉(zhuǎn)步距分辨率:200 to 400 框架大小 (NEMA):
ST10-IP-EN 功能描述:電機(jī)驅(qū)動(dòng)器 RoHS:否 制造商:Applied Motion 電機(jī)驅(qū)動(dòng)類型:2035 Step 電源電壓:12 V to 35 V 功率額定值:70 W 每轉(zhuǎn)步距分辨率:200 to 400 框架大小 (NEMA):
ST10-IP-EN (5000-181) 功能描述:電機(jī)驅(qū)動(dòng)器 RoHS:否 制造商:Applied Motion 電機(jī)驅(qū)動(dòng)類型:2035 Step 電源電壓:12 V to 35 V 功率額定值:70 W 每轉(zhuǎn)步距分辨率:200 to 400 框架大小 (NEMA):
ST10-PE 制造商:Phoenix Contact 功能描述:TERMINAL ST 10-PE
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