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參數(shù)資料
| 型號： | SPC5200CVR400 |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 9/80頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MPU 32BIT 400MHZ 272-PBGA |
| 標(biāo)準(zhǔn)包裝： | 40 |
| 系列： | MPC52xx |
| 處理器類型： | 32-位 MPC52xx PowerPC |
| 速度： | 400MHz |
| 電壓： | 1.5V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 272-BBGA |
| 供應(yīng)商設(shè)備封裝： | 272-PBGA（27x27） |
| 包裝： | 托盤 |
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Electrical and Thermal Characteristics
MPC5200 Data Sheet, Rev. 4
Freescale Semiconductor
17
For additional information, see the MPC5200 User Manual [1].
NOTE
Make sure that the PORRESET does not carry any glitches. The MPC5200
has no filter to prevent them from getting into the chip.
NOTE
HRESET and SRESET must have a monotonous rise time.
3.3.3.1
Reset Configuration Word
During reset (HRESET and PORRESET) the Reset Configuration Word is cached in the related Reset
Configuration Word Register with each rising edge of the SYS_XTAL signal. If both resets (HRESET and
PORRESET) are inactive (high), the contents of this register get locked after two further SYS_XTAL
cycles (see Figure 3).
Figure 3. Reset Configuration Word Locking
Table 15. Reset Rise / Fall Timing
Description
Min
Max
Unit
SpecID
PORRESET fall time
—
1
ms
A3.4
PORRESET rise time
—
1
ms
A3.5
HRESET fall time
—
1
ms
A3.6
HRESET rise time
—
1
ms
A3.7
SRESET fall time
—
1
ms
A3.8
SRESET rise time
—
1
ms
A3.9
sample
LOCK
RST_CFG_WRD
HRESET
PORRESET
SYS_XTAL
4096 clocks
2 clocks
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| SPC5200CVR400R2 | 功能描述:IC MPU 32BIT 400MHZ 272-PBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:MPC52xx 標(biāo)準(zhǔn)包裝:2 系列:MPC8xx 處理器類型:32-位 MPC8xx PowerQUICC 特點:- 速度:133MHz 電壓:3.3V 安裝類型:表面貼裝 封裝/外殼:357-BBGA 供應(yīng)商設(shè)備封裝:357-PBGA（25x25） 包裝:托盤 |
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