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參數(shù)資料
| 型號： | SPAK56853FG120 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 16-BIT, 4 MHz, OTHER DSP, PQFP128 |
| 封裝： | LQFP-128 |
| 文件頁數(shù)： | 491/649頁 |
| 文件大小： | 7965K |
| 代理商： | SPAK56853FG120 |
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MOTOROLA
Appendix - B Programmer’s Sheets
B-71
Preliminary
Application:
Date:
Programmer:
Sheet
B
ESSI Control Register 2 (SCR2)
5 of 16
Bits
Name
Description
15
RIE
Receive Interrupt Enable
This control bit allows interrupting the program controller
0
Receive FIFO is disabled: No interrupt is generated
1
Receive FIFO is disabled: Interrupt is generated if the RDR flag in the SSR is set
0
Receive FIFO is enabled: No interrupt is generated
1
Receive FIFO is enabled: Interrupt is generated if the RFF flag in the SSR is set
14
TIE
Transmit Interrupt Enable
This control bit provides program controller interruption
0
Transmit FIFO is disabled: No interrupt is generated
1
Transmit FIFO is disabled: Interrupt is generated if the TDE flag in the SSR is set
0
Transmit FIFO is enabled: No interrupt is generated
1
Transmit FIFO is enabled: Interrupt is generated if the TFE flag in the SSR is set
13
RE
Receive Enable
This control bit enables the receive portion of the ESSI
0
Receiver is disabled by inhibiting data transfer into the SRX
1
Receiver portion of the ESSI is enabled and received data will be processed
beginning with the next frame sync
12
TE0
Transmit Enable 0
This control bit enables the transfer of the contents of the STX0 register to its TXSR0
0
The transmitter continues to send data in TXSRO, then transmitter is disabled
1
On the next frame boundary, the transmit 0 portion of the ESSI is enabled
11
TE1
Transmit Enable 1
This control bit enables the transfer of the contents of the STX1 register to its TXSR1
0
Transmitter continues to send data currently in TXSR1, then disables transmitter
1
On the next frame boundary, the transmit 1 portion of the ESSI is enabled
10
TE2
Transmit Enable 2
This control bit enables the transfer of the contents of the STX2 register to its TXSR2
0
Transmitter continues to send data currently in TXSR2, then disables transmitter
1
On the next frame boundary, the transmit 2 portion of the ESSI is enabled
ESSI Control
Register 2 (SCR2)
Base + $5
Bits
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Read
RIE
TIE RE TE0 TE1 TE2
SYN TSHFD TSCKP ESSIEN NET TFSI TFSL TEFS
Write
RESET
00000
0
ESSI
denotes Reserved Bits
See the following page for continuation of this register
相關PDF資料 |
PDF描述 |
|---|---|
| SPAK56855BU120 | 16-BIT, 4 MHz, OTHER DSP, PQFP100 |
| SPAK56854FG120 | 16-BIT, 4 MHz, OTHER DSP, PQFP128 |
| SPAK56F802TA60 | 0-BIT, 60 MHz, OTHER DSP, PQFP32 |
| SPAK56F805FV80 | 16-BIT, 8 MHz, OTHER DSP, PQFP144 |
| SPAK56F807VF80 | 16-BIT, 80 MHz, OTHER DSP, PBGA160 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| SPAK56854FG120 | 制造商:Freescale Semiconductor 功能描述: |
| SPAK56857BU120 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:120 MIPS Hybrid Processor |
| SPAK56F803BU80 | 制造商:Freescale Semiconductor 功能描述: |
| SPAK56F805FV80 | 制造商:Freescale Semiconductor 功能描述: |
| SPAKDSP303AG100 | 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC SPAKDSP303AG100 RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT |
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