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參數(shù)資料
| 型號： | SPAK56853FG120 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 16-BIT, 4 MHz, OTHER DSP, PQFP128 |
| 封裝： | LQFP-128 |
| 文件頁數(shù)： | 227/649頁 |
| 文件大?。?/td> | 7965K |
| 代理商： | SPAK56853FG120 |
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12-32
DSP56853/854/855/857/858 User’s Manual
MOTOROLA
Preliminary
Register Descriptions (ESSI0_BASE = $1FFE20, ESSI1_BASE = $1FFE00)
12
12.7.7.5 Transmit Last Slot (TLS)—Bit 11
This is a status bit indicating the timing of the last transmit slot during the Network mode
operation. When this bit is set, the Transmit Last Slot Interrupt is asserted. The interrupt
service routine for this interrupt should read the status register, then write 1 to this bit to
clear the interrupt.
If the Transmit Last Slot Interrupt is not enabled, this bit can be read by the software to
determine the timing of the last slot. When the TLIE bit in the SCR3 register is disabled
the status bit will only be asserted during the last slot timing.
0 = Not currently transmitting the last time slot of the transmit frame
1 = Last slot of the transmit frame is currently being transmitted
12.7.7.6 Receive Last Slot (RLS)—Bit 10
This is a status bit indicating the timing of the last receive slot during the Network mode
operation. When this bit is set, the Receive Last Slot (RLS) interrupt bit is asserted. The
interrupt service routine for this interrupt should read the status register and then write a 1
to this bit to clear the interrupt.
If the RLS interrupt is not enabled, this bit can be read by the software to determine the
timing of the last slot. When the RLIE bit in the SCR3 register is disabled the status bit
will only be asserted during the last slot timing.
0 = Not currently receiving the last time slot of the receive frame
1 = Last slot of the receive frame is currently being received
12.7.7.7 Transmit FIFO 1 Error (TF1ERR)—Bit 9
When the transmitter status control TXSF1 is set and FIFOs are in use, this status bit will
indicate the state of FIFO 1 is not the same as FIFO 0. If transmitter 0 (TXSF0 = 0) is not
in use this flag can never be set.
0 = State of TXFIFO0 and TXFIFO1 are the same (contain the same amount of
data)
1 = State of TXFIFO0 is different than the state of TXFIFO1
12.7.7.8 Transmit FIFO 2 Error (TF2ERR)—Bit 8
When the transmitter status control TXSF2 is set and FIFOs are in use, this status bit
indicates the state of FIFO2 is not the same as FIFO0. If transmitter 0 (TXSF0 = 0) is not
in use, this status bit will indicate the state of FIFO2 is not the same as FIFO1. If
transmitter 1 is also not operating (TXSF0 = TXSF1 = 0), this flag can never be set.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SPAK56855BU120 | 16-BIT, 4 MHz, OTHER DSP, PQFP100 |
| SPAK56854FG120 | 16-BIT, 4 MHz, OTHER DSP, PQFP128 |
| SPAK56F802TA60 | 0-BIT, 60 MHz, OTHER DSP, PQFP32 |
| SPAK56F805FV80 | 16-BIT, 8 MHz, OTHER DSP, PQFP144 |
| SPAK56F807VF80 | 16-BIT, 80 MHz, OTHER DSP, PBGA160 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SPAK56854FG120 | 制造商:Freescale Semiconductor 功能描述: |
| SPAK56857BU120 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:120 MIPS Hybrid Processor |
| SPAK56F803BU80 | 制造商:Freescale Semiconductor 功能描述: |
| SPAK56F805FV80 | 制造商:Freescale Semiconductor 功能描述: |
| SPAKDSP303AG100 | 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC SPAKDSP303AG100 RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT |
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