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參數(shù)資料
| 型號(hào)： | SLA24C64-S |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 元件分類： | PROM |
| 英文描述： | 8K X 8 I2C/2-WIRE SERIAL EEPROM, PDSO8 |
| 封裝： | PLASTIC, DSO-8 |
| 文件頁(yè)數(shù)： | 19/28頁(yè) |
| 文件大?。?/td> | 367K |
| 代理商： | SLA24C64-S |
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SLx 24C64
Semiconductor Group
26
1999-02-02
1)
The minimum rise and fall times can be calculated as follows: (20 + (0.1/pF)
× C
b) ns
Example:
C
b = 100 pF → tR = (20 + 0.1 × 100) ns = 30 ns
8.3
AC Characteristics
Parameter
Symbol
Limit Values
V
CC = 2.7-5.5 V
Limit Values
V
CC = 4.5-5.5 V
Units
min.
max.
min.
max.
SCL clock frequency
f
SCL
100
400
kHz
Clock pulse width low
t
low
4.7
1.2
s
Clock pulse width high
t
high
4.0
0.6
s
SDA and SCL rise time
t
R
1000
1)
300
ns
SDA and SCL fall time
t
F
300
1)
300
ns
Start set-up time
t
SU.STA
4.7
0.6
s
Start hold time
t
HD.STA
4.0
0.6
s
Data in set-up time
t
SU.DAT
200
100
ns
Data in hold time
t
HD.DAT
00
s
SCL low to SDA data out valid
t
AA
0.1
4.5
0.1
0.9
s
Data out hold time
t
DH
100
50
ns
Stop set-up time
t
SU.STO
4.0
0.6
s
Time the bus must be free before
a new transmission can start
t
BUF
4.7
1.2
s
SDA and SCL spike suppression
time at constant inputs
t
l
50
100
50
100
ns
8.4
Erase and Write Characteristics
Parameter
Symbol
Limit Values
V
CC = 2.7-5.5 V
Limit Values
V
CC = 4.5-5.5 V
Units
typ.
max.
typ.
max.
Erase + write cycle (per page)
t
WR
58
5
8
ms
Erase page protection bit
2.5
4
2.5
4
ms
Write page protection bit
2.5
4
2.5
4
ms
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SLA3004M | 1.5 A SWITCHING REGULATOR, 60 kHz SWITCHING FREQ-MAX, PZFM15 |
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| SLA5506 | FPGA, 202675 GATES |
| SLA6270 | FPGA, 1734 GATES |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SLA24C64-S/P | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:64 Kbit 8192 x 8 bit Serial CMOS EEPROMs, I2C Synchronous 2-Wire Bus |
| SLA24C64-S-3 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:64 Kbit 8192 x 8 bit Serial CMOS EEPROMs, I2C Synchronous 2-Wire Bus |
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